Зміст
Добірка наукової літератури з теми "CONVENTIONAL CLOCK GATING"
Оформте джерело за APA, MLA, Chicago, Harvard та іншими стилями
Ознайомтеся зі списками актуальних статей, книг, дисертацій, тез та інших наукових джерел на тему "CONVENTIONAL CLOCK GATING".
Біля кожної праці в переліку літератури доступна кнопка «Додати до бібліографії». Скористайтеся нею – і ми автоматично оформимо бібліографічне посилання на обрану працю в потрібному вам стилі цитування: APA, MLA, «Гарвард», «Чикаго», «Ванкувер» тощо.
Також ви можете завантажити повний текст наукової публікації у форматі «.pdf» та прочитати онлайн анотацію до роботи, якщо відповідні параметри наявні в метаданих.
Статті в журналах з теми "CONVENTIONAL CLOCK GATING"
Jyothula, Sudhakar. "Low power aware pulse triggered flip flops using modified clock gating approaches." World Journal of Engineering 15, no. 6 (December 3, 2018): 792–803. http://dx.doi.org/10.1108/wje-09-2017-0309.
Повний текст джерелаJung, Jun Mo, and Jong-Wha Chong. "A Low Power FIR Filter Design for Image Processing." VLSI Design 12, no. 3 (January 1, 2001): 391–97. http://dx.doi.org/10.1155/2001/54974.
Повний текст джерелаLaskar, Nivedita, Suman Debnath, Alak Majumder, and Bidyut Kumar Bhattacharyya. "A New Current Profile Determination Methodology Incorporating Gating Logic to Minimize the Noise of CPU Chip by 40%." Journal of Circuits, Systems and Computers 27, no. 03 (October 30, 2017): 1850049. http://dx.doi.org/10.1142/s0218126618500494.
Повний текст джерелаTouil, Lamjed, Abdelaziz Hamdi, Ismail Gassoumi, and Abdellatif Mtibaa. "Design of Low-Power Structural FIR Filter Using Data-Driven Clock Gating and Multibit Flip-Flops." Journal of Electrical and Computer Engineering 2020 (July 10, 2020): 1–9. http://dx.doi.org/10.1155/2020/8108591.
Повний текст джерелаPrema, S., N. Karthikeyan, and S. Karthik. "Ultra-Low Power and High Sensitivity of Joint Clock Gating Based Dual Feedback Edge Triggered Flip Flop for Biomedical Imaging Applications." Journal of Medical Imaging and Health Informatics 11, no. 12 (December 1, 2021): 3215–22. http://dx.doi.org/10.1166/jmihi.2021.3919.
Повний текст джерелаKannan, L. Mohana, and Deepa D. "Low power and area efficient design of fir filter using enhanced clock gating technique." Journal of Engineering Research 9 (October 27, 2021). http://dx.doi.org/10.36909/jer.11307.
Повний текст джерелаJayanthi, VE, Senthil Pitchai, and M. Smitha. "Design a Hybrid FPGA Architecture for Visible Digital Image Watermarking in Spatial and Frequency Domain." Journal of Circuits, Systems and Computers, July 23, 2021, 2250020. http://dx.doi.org/10.1142/s0218126622500207.
Повний текст джерелаДисертації з теми "CONVENTIONAL CLOCK GATING"
MULANI, JUNED ALTAF. "POWER, PERFORMANCE AND AREA METRICS IN VLSI DESIGN: AN ANALYTICAL APPROACH." Thesis, 2023. http://dspace.dtu.ac.in:8080/jspui/handle/repository/19849.
Повний текст джерела