Artykuły w czasopismach na temat „Gate array circuits”
Utwórz poprawne odniesienie w stylach APA, MLA, Chicago, Harvard i wielu innych
Sprawdź 50 najlepszych artykułów w czasopismach naukowych na temat „Gate array circuits”.
Przycisk „Dodaj do bibliografii” jest dostępny obok każdej pracy w bibliografii. Użyj go – a my automatycznie utworzymy odniesienie bibliograficzne do wybranej pracy w stylu cytowania, którego potrzebujesz: APA, MLA, Harvard, Chicago, Vancouver itp.
Możesz również pobrać pełny tekst publikacji naukowej w formacie „.pdf” i przeczytać adnotację do pracy online, jeśli odpowiednie parametry są dostępne w metadanych.
Przeglądaj artykuły w czasopismach z różnych dziedzin i twórz odpowiednie bibliografie.
Abraitis, Vidas, i Žydrūnas Tamoševičius. "Transition Test Patterns Generation for BIST Implemented in ASIC and FPGA". Solid State Phenomena 144 (wrzesień 2008): 214–19. http://dx.doi.org/10.4028/www.scientific.net/ssp.144.214.
Pełny tekst źródłaMowafy, Aya Nabeel. "Asynchronous Circuits Design Using a Field Programmable Gate Array". International Journal for Research in Applied Science and Engineering Technology 6, nr 4 (30.04.2018): 2423–32. http://dx.doi.org/10.22214/ijraset.2018.4412.
Pełny tekst źródłaMohammadi, Hossein, i Keivan Navi. "Energy-Efficient Single-Layer QCA Logical Circuits Based on a Novel XOR Gate". Journal of Circuits, Systems and Computers 27, nr 14 (23.08.2018): 1850216. http://dx.doi.org/10.1142/s021812661850216x.
Pełny tekst źródłaSato, Ryoichi, Yuta Kodera, Md Arshad Ali, Takuya Kusaka, Yasuyuki Nogami i Robert H. Morelos-Zaragoza. "Consideration for Affects of an XOR in a Random Number Generator Using Ring Oscillators". Entropy 23, nr 9 (5.09.2021): 1168. http://dx.doi.org/10.3390/e23091168.
Pełny tekst źródłaKuboki, S., I. Masuda, T. Hayashi i S. Torii. "A 4K CMOS gate array with automatically generated test circuits". IEEE Journal of Solid-State Circuits 20, nr 5 (październik 1985): 1018–24. http://dx.doi.org/10.1109/jssc.1985.1052430.
Pełny tekst źródłaAKELLA, KAPILAN MAHESWARAN VENKATESH. "PGA-STC: programmable gate array for implementing self-timed circuits". International Journal of Electronics 84, nr 3 (marzec 1998): 255–67. http://dx.doi.org/10.1080/002072198134823.
Pełny tekst źródłaMurtaza, Ali Faisal, i Hadeed Ahmed Sher. "A Reconfiguration Circuit to Boost the Output Power of a Partially Shaded PV String". Energies 16, nr 2 (4.01.2023): 622. http://dx.doi.org/10.3390/en16020622.
Pełny tekst źródłaJaafar, Anuar, Norhayati Soin, Sharifah F. Wan Muhamad Hatta, Sani Irwan Salim i Zahriladha Zakaria. "Multipoint Detection Technique with the Best Clock Signal Closed-Loop Feedback to Prolong FPGA Performance". Applied Sciences 11, nr 14 (12.07.2021): 6417. http://dx.doi.org/10.3390/app11146417.
Pełny tekst źródłaCherepacha, Don, i David Lewis. "DP-FPGA: An FPGA Architecture Optimized for Datapaths". VLSI Design 4, nr 4 (1.01.1996): 329–43. http://dx.doi.org/10.1155/1996/95942.
Pełny tekst źródłaReaungepattanawiwat, Chalermpol, i Yutthana Kanthaphayao. "Voltage Multiplier Circuits with Coupled-Inductor Applied to a High Step-Up DC-DC Converter". Applied Mechanics and Materials 781 (sierpień 2015): 418–21. http://dx.doi.org/10.4028/www.scientific.net/amm.781.418.
Pełny tekst źródłaHarrison, R. R., J. A. Bragg, P. Hasler, B. A. Minch i S. P. Deweerth. "A CMOS programmable analog memory-cell array using floating-gate circuits". IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing 48, nr 1 (2001): 4–11. http://dx.doi.org/10.1109/82.913181.
Pełny tekst źródłaTANAKA, YU. "EXACT NON-IDENTITY CHECK IS NQP-COMPLETE". International Journal of Quantum Information 08, nr 05 (sierpień 2010): 807–19. http://dx.doi.org/10.1142/s0219749910006599.
Pełny tekst źródłaChin, Scott Y. L., Clarence S. P. Lee i Steven J. E. Wilton. "On the Power Dissipation of Embedded Memory Blocks Used to Implement Logic in Field-Programmable Gate Arrays". International Journal of Reconfigurable Computing 2008 (2008): 1–13. http://dx.doi.org/10.1155/2008/751863.
Pełny tekst źródłaLin, Y., Fei Li i Lei He. "Circuits and architectures for field programmable gate array with configurable supply voltage". IEEE Transactions on Very Large Scale Integration (VLSI) Systems 13, nr 9 (wrzesień 2005): 1035–47. http://dx.doi.org/10.1109/tvlsi.2005.857180.
Pełny tekst źródłaLiu, Lijun, Jie Han, Lin Xu, Jianshuo Zhou, Chenyi Zhao, Sujuan Ding, Huiwen Shi i in. "Aligned, high-density semiconducting carbon nanotube arrays for high-performance electronics". Science 368, nr 6493 (21.05.2020): 850–56. http://dx.doi.org/10.1126/science.aba5980.
Pełny tekst źródłaSotohebo, Takashi, Minoru Watanabe i Funtinori Kobayashi. "An FPGA Implementation of Finite Physical Quantity Neural Network". Journal of Robotics and Mechatronics 15, nr 2 (20.04.2003): 136–42. http://dx.doi.org/10.20965/jrm.2003.p0136.
Pełny tekst źródłaTrost, Andrej, Andrej Zemva i Matjaz Verderber. "Prototyping Hardware and Software Environment for Teaching Digital Circuit Design". International Journal of Electrical Engineering & Education 38, nr 4 (październik 2001): 368–78. http://dx.doi.org/10.7227/ijeee.38.4.9.
Pełny tekst źródłaCabrita, Daniel Mealha, i Carlos Raimundo Erig Lima. "A Fast Simulator in FPGA for LUT-Based Combinational Logic Circuits of Arbitrary Topology for Evolutionary Algorithms". Journal of Circuits, Systems and Computers 25, nr 02 (23.12.2015): 1650009. http://dx.doi.org/10.1142/s0218126616500092.
Pełny tekst źródłaZheng, Fang Yan, Zi Ran Chen i Zhi Cheng Yu. "Signal Processing Circuit Design Based on SOPC Technology for the Electric Field Type Time Grating Sensors". Applied Mechanics and Materials 635-637 (wrzesień 2014): 755–59. http://dx.doi.org/10.4028/www.scientific.net/amm.635-637.755.
Pełny tekst źródłaTakahashi, T., M. Uchida, T. Takahashi, R. Yoshino, M. Yamamoto i N. Kitamura. "A CMOS gate array with 600 Mb/s simultaneous bidirectional I/O circuits". IEEE Journal of Solid-State Circuits 30, nr 12 (1995): 1544–46. http://dx.doi.org/10.1109/4.482204.
Pełny tekst źródłaFehr, E. Scott, Stephen A. Szygenda i Granville E. Ott. "An Integrated Hardware Array for Very High Speed Logic Simulation". VLSI Design 4, nr 2 (1.01.1996): 107–18. http://dx.doi.org/10.1155/1996/13931.
Pełny tekst źródłaRayudu, Kurada Verra Bhoga Vasantha, Dhananjay Ramachandra Jahagirdar i Patri Srihari Rao. "Design and testing of systolic array multiplier using fault injecting schemes". Computer Science and Information Technologies 3, nr 1 (1.03.2022): 1–9. http://dx.doi.org/10.11591/csit.v3i1.p1-9.
Pełny tekst źródłaTung, Dam Minh, Nguyen Van Toan i Jeong-Gun Lee. "A One-Cycle Correction Error-Resilient Flip-Flop for Variation-Tolerant Designs on an FPGA". Electronics 9, nr 4 (10.04.2020): 633. http://dx.doi.org/10.3390/electronics9040633.
Pełny tekst źródłaPfänder, O. A., R. Nopper, H. J. Pfleiderer, S. Zhou i A. Bermak. "Comparison of reconfigurable structures for flexible word-length multiplication". Advances in Radio Science 6 (26.05.2008): 113–18. http://dx.doi.org/10.5194/ars-6-113-2008.
Pełny tekst źródłaOkuno, Hirotsugu, i Tetsuya Yagi. "Bio-Inspired Real-Time Robot Vision for Collision Avoidance". Journal of Robotics and Mechatronics 20, nr 1 (20.02.2008): 68–74. http://dx.doi.org/10.20965/jrm.2008.p0068.
Pełny tekst źródłaHidalgo-López, José A., Óscar Oballe-Peinado, Julián Castellanos-Ramos i José A. Sánchez-Durán. "Two-Capacitor Direct Interface Circuit for Resistive Sensor Measurements". Sensors 21, nr 4 (22.02.2021): 1524. http://dx.doi.org/10.3390/s21041524.
Pełny tekst źródłaYoshikawa, Masaya, Yusuke Mori i Takeshi Kumaki. "Implementation Aware Hardware Trojan Trigger". Advanced Materials Research 933 (maj 2014): 482–86. http://dx.doi.org/10.4028/www.scientific.net/amr.933.482.
Pełny tekst źródłaLiu, Yixuan, Qiao Hu, Qiqiao Wu, Xuanzhi Liu, Yulin Zhao, Donglin Zhang, Zhongze Han i in. "Probabilistic Circuit Implementation Based on P-Bits Using the Intrinsic Random Property of RRAM and P-Bit Multiplexing Strategy". Micromachines 13, nr 6 (10.06.2022): 924. http://dx.doi.org/10.3390/mi13060924.
Pełny tekst źródłaSun, Jun-Wei, Xing-Tong Zhao i Yan-Feng Wang. "Multi-Input Look-Up-Table Design Based on Nanometer Memristor". Journal of Nanoelectronics and Optoelectronics 15, nr 1 (1.01.2020): 113–21. http://dx.doi.org/10.1166/jno.2020.2721.
Pełny tekst źródłaCheng, Shi, JinBao Zhang, Zhan Gao i Jiehua Wang. "Circuit Implementation of Respiratory Information Extracted from Electrocardiograms". Journal of Database Management 33, nr 2 (1.04.2022): 1–12. http://dx.doi.org/10.4018/jdm.314211.
Pełny tekst źródłaPoghossian, Arshak, Rene Welden, Vahe V. Buniatyan i Michael J. Schöning. "An Array of On-Chip Integrated, Individually Addressable Capacitive Field-Effect Sensors with Control Gate: Design and Modelling". Sensors 21, nr 18 (14.09.2021): 6161. http://dx.doi.org/10.3390/s21186161.
Pełny tekst źródłaMayacela, Margarita, Leonardo Rentería, Luis Contreras i Santiago Medina. "Comparative Analysis of Reconfigurable Platforms for Memristor Emulation". Materials 15, nr 13 (25.06.2022): 4487. http://dx.doi.org/10.3390/ma15134487.
Pełny tekst źródłaYe, A., i J. Rose. "Using bus-based connections to improve field-programmable gate-array density for implementing datapath circuits". IEEE Transactions on Very Large Scale Integration (VLSI) Systems 14, nr 5 (maj 2006): 462–73. http://dx.doi.org/10.1109/tvlsi.2006.876095.
Pełny tekst źródłaŻbik, Mateusz, i Piotr Wieczorek. "Charge-Line Dual-FET High-Repetition-Rate Pulsed Laser Driver". Applied Sciences 9, nr 7 (27.03.2019): 1289. http://dx.doi.org/10.3390/app9071289.
Pełny tekst źródłaRamezani, Hadise, Majid Mohammadi i Amir Sabbagh Molahosseini. "An efficient look up table based approximate adder for field programmable gate array". Indonesian Journal of Electrical Engineering and Computer Science 25, nr 1 (1.01.2022): 144. http://dx.doi.org/10.11591/ijeecs.v25.i1.pp144-151.
Pełny tekst źródłaXu, Baohe, Li Lu i Dawei Gong. "Research on Real-time Simulation of Power Electronic Circuits Based on Simscape". Journal of Physics: Conference Series 2196, nr 1 (1.02.2022): 012025. http://dx.doi.org/10.1088/1742-6596/2196/1/012025.
Pełny tekst źródłaKondo, Jun, Murali Lingalugari, Pik-Yiu Chan, Evan Heller i Faquir Jain. "Modeling and Fabrication of Quantum Dot Channel Field Effect Transistors Incorporating Quantum Dot Gate". MRS Proceedings 1551 (2013): 149–54. http://dx.doi.org/10.1557/opl.2013.899.
Pełny tekst źródłaAbbas, Abdulkareem Dawah. "Review of high-speed phase accumulator for direct digital frequency synthesizer". International Journal of Electrical and Computer Engineering (IJECE) 10, nr 4 (1.08.2020): 4008. http://dx.doi.org/10.11591/ijece.v10i4.pp4008-4014.
Pełny tekst źródłaPoudel, Bikash, Arslan Munir, Joonho Kong i Muazzam A. Khan. "Design and Validation of Low-Power Secure and Dependable Elliptic Curve Cryptosystem". Journal of Low Power Electronics and Applications 11, nr 4 (12.11.2021): 43. http://dx.doi.org/10.3390/jlpea11040043.
Pełny tekst źródłasriraman, Harini, i Pattabiraman Venkatasubbu. "SeRA: Self-Repairing Architecture for Dark Silicon Era". Journal of Circuits, Systems and Computers 29, nr 04 (13.06.2019): 2050053. http://dx.doi.org/10.1142/s021812662050053x.
Pełny tekst źródłaWard, Tyler, Neil Grabham, Chris Freeman, Yang Wei, Ann-Marie Hughes, Conor Power, John Tudor i Kai Yang. "Multichannel Biphasic Muscle Stimulation System for Post Stroke Rehabilitation". Electronics 9, nr 7 (17.07.2020): 1156. http://dx.doi.org/10.3390/electronics9071156.
Pełny tekst źródłaM, Saravanan, Nandakumar R i Veerabalaji G. "Effectual SVPWM Techniques and Implementation of FPGA Based Induction Motor Drive". International Journal of Reconfigurable and Embedded Systems (IJRES) 1, nr 1 (1.03.2012): 11. http://dx.doi.org/10.11591/ijres.v1.i1.pp11-18.
Pełny tekst źródłaLee, Bong Wan, Min Seong Seo, Ho Guen Oh i Chan Yik Park. "High-Speed Wavelength Interrogator of Fiber Bragg Gratings for Capturing Impulsive Strain Waveforms". Advanced Materials Research 123-125 (sierpień 2010): 867–70. http://dx.doi.org/10.4028/www.scientific.net/amr.123-125.867.
Pełny tekst źródłaZhang, Kai, Jihao Gao, YunFei Wang i MingLiang Liang. "Hardware Realization of Kinematic Mechanism and Control System of Multifunctional Industrial Robot". Security and Communication Networks 2022 (10.09.2022): 1–5. http://dx.doi.org/10.1155/2022/1940708.
Pełny tekst źródłaFang, R. C. Y., K. Y. Su i J. J. Hsu. "A two-dimensional analysis of sheet and contact resistance effects in basic cells of gate-array circuits". IEEE Journal of Solid-State Circuits 20, nr 2 (kwiecień 1985): 481–88. http://dx.doi.org/10.1109/jssc.1985.1052333.
Pełny tekst źródłaVu, T. T., R. D. Nelson, G. M. Lee, P. C. T. Roberts, K. W. Lee, S. K. Swanson, A. Peczalski i in. "Low-power 2K-cell SDFL gate array and DCFL circuits using GaAs self-aligned E/D MESFETs". IEEE Journal of Solid-State Circuits 23, nr 1 (luty 1988): 224–38. http://dx.doi.org/10.1109/4.283.
Pełny tekst źródłaLi, Xin, Qiufan Cheng, Shiliang Guo i Zhiquan Li. "Research of Gate-Tunable Phase Modulation Metasurfaces Based on Epsilon-Near-Zero Property of Indium-Tin-Oxide". Photonics 9, nr 5 (9.05.2022): 323. http://dx.doi.org/10.3390/photonics9050323.
Pełny tekst źródłaOukaira, Aziz, Ahmad Hassan, Mohamed Ali, Yvon Savaria i Ahmed Lakhssassi. "Towards Real-Time Monitoring of Thermal Peaks in Systems-on-Chip (SoC)". Sensors 22, nr 15 (7.08.2022): 5904. http://dx.doi.org/10.3390/s22155904.
Pełny tekst źródłaZhang, Bingda, Xianglong Jin, Sijia Tu, Zhao Jin i Jie Zhang. "A New FPGA-Based Real-Time Digital Solver for Power System Simulation". Energies 12, nr 24 (8.12.2019): 4666. http://dx.doi.org/10.3390/en12244666.
Pełny tekst źródłaOhkawa, Takeshi, Daichi Uetake, Takashi Yokota i Kanemitsu Ootsu. "Component-Based FPGA Circuit Design and Verification for Robotic Systems Using JavaRock and ORB Engine - A Case Study". Applied Mechanics and Materials 433-435 (październik 2013): 1849–52. http://dx.doi.org/10.4028/www.scientific.net/amm.433-435.1849.
Pełny tekst źródła