Littérature scientifique sur le sujet « VEDIC MATHEMATICS TOOL »
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Articles de revues sur le sujet "VEDIC MATHEMATICS TOOL"
Rešić, Sead, et Adin Lemo. « VEDIC MATHEMATICS ». Journal Human Research in Rehabilitation 5, no 2 (septembre 2015) : 23–30. http://dx.doi.org/10.21554/hrr.091509.
Texte intégralKhan, Angshuman, Sudip Halder et Shubhajit Pal. « Design of ASIC Square Calculator Using AncientVedic Mathematics ». International Journal of Engineering & ; Technology 7, no 2.23 (20 avril 2018) : 464. http://dx.doi.org/10.14419/ijet.v7i2.23.15334.
Texte intégralKuruvilla, Siya Susan, Stephani Sunil, Abisha Susan Alichan et Abraham K. Thomas. « Comparison of Vedic Multiplier Implementation Using Gate Diffusion Input and Modified Gate Diffusion Input Techniques ». Journal of Signal Processing 8, no 2 (22 juin 2022) : 1–5. http://dx.doi.org/10.46610/josp.2022.v08i02.001.
Texte intégralKhubnani, Rashi, Tarunika Sharma et Chitirala Subramanyam. « Applications of Vedic multiplier - A Review ». Journal of Physics : Conference Series 2225, no 1 (1 mars 2022) : 012003. http://dx.doi.org/10.1088/1742-6596/2225/1/012003.
Texte intégralBharatha Babu, K., et V. Anupriya. « VLSI Design Based Delay and Power Performance Comparison and Analysis of Multipliers ». Multidisciplinary Journal for Applied Research in Engineering and Technology I, no I (29 août 2021). http://dx.doi.org/10.54228/mjaret08210009.
Texte intégralPATRO, ARUN K., et KUNAL N. DEKATE. « A TRANSISTOR LEVEL ANALYSIS FOR A 8-BIT VEDIC MULTIPLIER ». International Journal of Electronics Signals and Systems, octobre 2012, 78–83. http://dx.doi.org/10.47893/ijess.2012.1086.
Texte intégral« Delay Efficient Vedic Multiplier for DSP ». International Journal of Innovative Technology and Exploring Engineering 8, no 9S (23 août 2019) : 499–501. http://dx.doi.org/10.35940/ijitee.i1078.0789s19.
Texte intégralGopinath, Jini K., et Rita Krishnan. « Vedic mathematics training in specific learning difficulty : A study on upper primary children ». Indian Journal of Positive Psychology 9, no 01 (6 avril 2018). http://dx.doi.org/10.15614/ijpp.v9i01.11750.
Texte intégralKhan, Angshuman, Sudip Halder, Souvik Saha et Rajeev Arya. « FPGA Implementation of Vedic Squarer for Communication Systems ». International Journal of Sensors, Wireless Communications and Control 09 (11 juin 2019). http://dx.doi.org/10.2174/2210327909666190611143919.
Texte intégralBaranov, V. M. « An Original Analytical Study of Innovative Legal Technologies. Review of the Monograph By Degtyarev M.V. “The Latest Regulatory Technologies and Tools : Regulatory Experiments, Sandboxes, Guillotines, Ecosystems, Platforms” / Edited by Prof. I.V. Ponkin / Moscow State Law University Named After O.E. Kutafin (MSLA). M. : Buki Vedi, 2022. 424 p.) ». Proceedings of the Institute of State and Law of the RAS, 28 juillet 2022, 168–81. http://dx.doi.org/10.35427/2073-4522-2022-17-3-baranov.
Texte intégralThèses sur le sujet "VEDIC MATHEMATICS TOOL"
RUHELA, DIKSHA. « DESIGN AND IMPLEMENTATION OF EFFICIENT REVERSIBLE MULTIPLIER USING VEDIC MATHEMATICS TOOL ». Thesis, 2016. http://dspace.dtu.ac.in:8080/jspui/handle/repository/14759.
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