Articles de revues sur le sujet « Multi-core execution »
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Fang, Juan, et Hong Bo Zhang. « An Improved Architecture for Multi-Core Prefetching ». Advanced Materials Research 505 (avril 2012) : 253–56. http://dx.doi.org/10.4028/www.scientific.net/amr.505.253.
Texte intégralChen, Xiaowen. « Command-Triggered Microcode Execution for Distributed Shared Memory Based Multi-Core Network-on-Chips ». Journal of Software 10, no 2 (février 2015) : 142–61. http://dx.doi.org/10.17706/jsw.10.2.142-161.
Texte intégralMaity, Arka, Anuj Pathania et Tulika Mitra. « PkMin : Peak Power Minimization for Multi-Threaded Many-Core Applications ». Journal of Low Power Electronics and Applications 10, no 4 (30 septembre 2020) : 31. http://dx.doi.org/10.3390/jlpea10040031.
Texte intégralGriffin, Thomas A. N., Kenneth Shankland, Jacco van de Streek et Jason Cole. « MDASH : a multi-core-enabled program for structure solution from powder diffraction data ». Journal of Applied Crystallography 42, no 2 (5 mars 2009) : 360–61. http://dx.doi.org/10.1107/s0021889809006852.
Texte intégralChen, Gang, Kai Huang, Long Cheng, Biao Hu et Alois Knoll. « Dynamic Partitioned Cache Memory for Real-Time MPSoCs with Mixed Criticality ». Journal of Circuits, Systems and Computers 25, no 06 (31 mars 2016) : 1650062. http://dx.doi.org/10.1142/s0218126616500626.
Texte intégralSuleman, M. Aater, Onur Mutlu, Moinuddin K. Qureshi et Yale N. Patt. « Accelerating critical section execution with asymmetric multi-core architectures ». ACM SIGARCH Computer Architecture News 37, no 1 (mars 2009) : 253–64. http://dx.doi.org/10.1145/2528521.1508274.
Texte intégralChen, Kuan-Chung, et Chung-Ho Chen. « Enabling SIMT Execution Model on Homogeneous Multi-Core System ». ACM Transactions on Architecture and Code Optimization 15, no 1 (2 avril 2018) : 1–26. http://dx.doi.org/10.1145/3177960.
Texte intégralKulkarni, Abhishek, Latchesar Ionkov, Michael Lang et Andrew Lumsdaine. « Optimizing process creation and execution on multi-core architectures ». International Journal of High Performance Computing Applications 27, no 2 (2 avril 2013) : 147–61. http://dx.doi.org/10.1177/1094342013481483.
Texte intégralSuleman, M. Aater, Onur Mutlu, Moinuddin K. Qureshi et Yale N. Patt. « Accelerating critical section execution with asymmetric multi-core architectures ». ACM SIGPLAN Notices 44, no 3 (28 février 2009) : 253–64. http://dx.doi.org/10.1145/1508284.1508274.
Texte intégralHuang, Shujuan, Yi'an Zhu, Bailin Liu et Feng Xiao. « Research on Three Dimensional Scheduling Model for Embedded Multi-Core System ». Xibei Gongye Daxue Xuebao/Journal of Northwestern Polytechnical University 36, no 5 (octobre 2018) : 1020–25. http://dx.doi.org/10.1051/jnwpu/20183651020.
Texte intégralSaidi, Salah Eddine, Nicolas Pernet et Yves Sorel. « A method for parallel scheduling of multi-rate co-simulation on multi-core platforms ». Oil & ; Gas Science and Technology – Revue d’IFP Energies nouvelles 74 (2019) : 49. http://dx.doi.org/10.2516/ogst/2019009.
Texte intégralMikami, Hiro, Kei Torigoe, Makoto Inokawa et Masato Edahiro. « LLVM Instruction Latency Measurement for Software-Hardware Interface for Multi-many-core ». INTERNATIONAL JOURNAL OF COMPUTERS & ; TECHNOLOGY 22 (27 mai 2022) : 50–63. http://dx.doi.org/10.24297/ijct.v22i.9231.
Texte intégralRebaya, Asma, Karol Desnos et Salem Hasnaoui. « Translating Hierarchical Simulink Applications to Real-time multi-core Execution ». Universal Journal of Electrical and Electronic Engineering 7, no 4 (août 2020) : 242–61. http://dx.doi.org/10.13189/ujeee.2020.070403.
Texte intégralJena, Swagat Kumar, Satyabrata Das et Satya Prakash Sahoo. « Design and Development of a Parallel Lexical Analyzer for C Language ». International Journal of Knowledge-Based Organizations 8, no 1 (janvier 2018) : 68–82. http://dx.doi.org/10.4018/ijkbo.2018010105.
Texte intégralRinku, Dhruva R., et M. AshaRani. « Reinforcement learning based multi core scheduling (RLBMCS) for real time systems ». International Journal of Electrical and Computer Engineering (IJECE) 10, no 2 (1 avril 2020) : 1805. http://dx.doi.org/10.11591/ijece.v10i2.pp1805-1813.
Texte intégralLiu, Cong, Wen Wang et Zhi Ying Wang. « Speculative High Performance Computation on Heterogeneous Multi-Core ». Advanced Materials Research 1049-1050 (octobre 2014) : 2126–30. http://dx.doi.org/10.4028/www.scientific.net/amr.1049-1050.2126.
Texte intégralUddin, Irfan. « One-IPC high-level simulation of microthreaded many-core architectures ». International Journal of High Performance Computing Applications 31, no 2 (28 juillet 2016) : 152–62. http://dx.doi.org/10.1177/1094342015584495.
Texte intégralKarasik, O. N., et A. A. Prihozhy. « ADVANCED SCHEDULER FOR COOPERATIVE EXECUTION OF THREADS ON MULTI-CORE SYSTEM ». «System analysis and applied information science», no 1 (4 mai 2017) : 4–11. http://dx.doi.org/10.21122/2309-4923-2017-1-4-11.
Texte intégralSoliman, Mostafa I. « Exploiting ILP, TLP, and DLP to Improve Multi-Core Performance of One-Sided Jacobi SVD ». Parallel Processing Letters 19, no 02 (juin 2009) : 355–75. http://dx.doi.org/10.1142/s0129626409000262.
Texte intégralHU, WEI, TIANZHOU CHEN, QINGSONG SHI et SHA LIU. « CRITICAL-PATH DRIVEN ROUTERS FOR ON-CHIP NETWORKS ». Journal of Circuits, Systems and Computers 19, no 07 (novembre 2010) : 1543–57. http://dx.doi.org/10.1142/s021812661000689x.
Texte intégralKaiser, Benjamin, Matthias Keinert, Armin Lechler et Alexander Verl. « CNC Tool Path Generation on Multi-Core Processors ». Applied Mechanics and Materials 794 (octobre 2015) : 339–46. http://dx.doi.org/10.4028/www.scientific.net/amm.794.339.
Texte intégralOuyang, Xiangzhen, et Yian Zhu. « Core-aware combining : Accelerating critical section execution on heterogeneous multi-core systems via combining synchronization ». Journal of Parallel and Distributed Computing 162 (avril 2022) : 27–43. http://dx.doi.org/10.1016/j.jpdc.2022.01.001.
Texte intégralChu, Edward Tsung Hsien, et Ming Ru Tsai. « Using Multi-Core to Debug Interactive Applications ». Applied Mechanics and Materials 764-765 (mai 2015) : 1007–11. http://dx.doi.org/10.4028/www.scientific.net/amm.764-765.1007.
Texte intégralZhang, Lei, Ren Ping Dong et Ya Ping Yu. « Realization of SMS4 Algorithm Based on Share Memory of the Heterogeneous Multi-Core Password Chip System ». Applied Mechanics and Materials 668-669 (octobre 2014) : 1368–73. http://dx.doi.org/10.4028/www.scientific.net/amm.668-669.1368.
Texte intégralIman Fitri Ismail, Akmal Nizam Mohammed, Bambang Basuno, Siti Aisyah Alimuddin et Mustafa Alas. « Evaluation of CFD Computing Performance on Multi-Core Processors for Flow Simulations ». Journal of Advanced Research in Applied Sciences and Engineering Technology 28, no 1 (11 septembre 2022) : 67–80. http://dx.doi.org/10.37934/araset.28.1.6780.
Texte intégralSANTOS COSTA, VíTOR, INÊS DUTRA et RICARDO ROCHA. « Threads and or-parallelism unified ». Theory and Practice of Logic Programming 10, no 4-6 (juillet 2010) : 417–32. http://dx.doi.org/10.1017/s1471068410000190.
Texte intégralAbdulRazzaq, Atheer Akram, Qusay Shihab Hamad et Ahmed Majid Taha. « Parallel implementation of maximum-shift algorithm using OpenMp ». Indonesian Journal of Electrical Engineering and Computer Science 22, no 3 (1 juin 2021) : 1529. http://dx.doi.org/10.11591/ijeecs.v22.i3.pp1529-1539.
Texte intégralQiu, Yue, et Jing Feng Zang. « Based on Improved Genetic Algorithm for Task Scheduling of Heterogeneous Multi-Core Processor ». Advanced Materials Research 1030-1032 (septembre 2014) : 1671–75. http://dx.doi.org/10.4028/www.scientific.net/amr.1030-1032.1671.
Texte intégralMaghsoudloo, Mohammad, et Hamid Zarandi. « Parallel execution tracing : An alternative solution to exploit under-utilized resources in multi-core architectures for control-flow checking ». Facta universitatis - series : Electronics and Energetics 29, no 2 (2016) : 243–60. http://dx.doi.org/10.2298/fuee1602243m.
Texte intégralT R, Vinay, et Ajeet A. Chikkamannur. « A Machine Learning Technique for Abstraction of Modules in Legacy System and Assigning them on Multicore Machines Using and Controlling p-threads ». International Journal on Recent and Innovation Trends in Computing and Communication 10, no 12 (31 décembre 2022) : 21–25. http://dx.doi.org/10.17762/ijritcc.v10i12.5837.
Texte intégralAlonso, Pedro, Manuel F. Dolz, Rafael Mayo et Enrique S. Quintana-Ortí. « Energy-efficient execution of dense linear algebra algorithms on multi-core processors ». Cluster Computing 16, no 3 (12 mai 2012) : 497–509. http://dx.doi.org/10.1007/s10586-012-0215-x.
Texte intégralRajalakshmi, N. R., Ankur Dumka, Manoj Kumar, Rajesh Singh, Anita Gehlot, Shaik Vaseem Akram, Divya Anand, Dalia H. Elkamchouchi et Irene Delgado Noya. « A Cost-Optimized Data Parallel Task Scheduling with Deadline Constraints in Cloud ». Electronics 11, no 13 (28 juin 2022) : 2022. http://dx.doi.org/10.3390/electronics11132022.
Texte intégralDURAN, ALEJANDRO, EDUARD AYGUADÉ, ROSA M. BADIA, JESÚS LABARTA, LUIS MARTINELL, XAVIER MARTORELL et JUDIT PLANAS. « OmpSs : A PROPOSAL FOR PROGRAMMING HETEROGENEOUS MULTI-CORE ARCHITECTURES ». Parallel Processing Letters 21, no 02 (juin 2011) : 173–93. http://dx.doi.org/10.1142/s0129626411000151.
Texte intégralSørensen, Peter, et Jan Madsen. « Generating Process Network Communication Infrastructure for Custom Multi-Core Platforms ». International Journal of Embedded and Real-Time Communication Systems 1, no 1 (janvier 2010) : 37–63. http://dx.doi.org/10.4018/jertcs.2010103003.
Texte intégralNozal, Raúl, et Jose Luis Bosque. « Straightforward Heterogeneous Computing with the oneAPI Coexecutor Runtime ». Electronics 10, no 19 (29 septembre 2021) : 2386. http://dx.doi.org/10.3390/electronics10192386.
Texte intégralBielecki, Włodzimierz, Piotr Błaszyński et Marek Pałkowski. « 3D Tiled Code Generation for Nussinov’s Algorithm ». Applied Sciences 12, no 12 (9 juin 2022) : 5898. http://dx.doi.org/10.3390/app12125898.
Texte intégralR, Maheswari, Pattabiraman V et Sharmila P. « RECONFIGURABLE FPGA BASED SOFT-CORE PROCESSOR FOR SIMD APPLICATIONS ». Asian Journal of Pharmaceutical and Clinical Research 10, no 13 (1 avril 2017) : 180. http://dx.doi.org/10.22159/ajpcr.2017.v10s1.19632.
Texte intégralUDDIN, M. IRFAN, MICHIEL W. VAN TOL et CHRIS R. JESSHOPE. « HIGH LEVEL SIMULATION OF SVP MANY-CORE SYSTEMS ». Parallel Processing Letters 21, no 04 (décembre 2011) : 413–38. http://dx.doi.org/10.1142/s0129626411000308.
Texte intégralDümmler, Jörg, Thomas Rauber et Gudula Rünger. « Combined Scheduling and Mapping for Scalable Computing with Parallel Tasks ». Scientific Programming 20, no 1 (2012) : 45–67. http://dx.doi.org/10.1155/2012/514940.
Texte intégralWeisz, Sergiu, et Marta Bertran Ferrer. « Adding multi-core support to the ALICE Grid Middleware ». Journal of Physics : Conference Series 2438, no 1 (1 février 2023) : 012009. http://dx.doi.org/10.1088/1742-6596/2438/1/012009.
Texte intégralZhai, Wenzheng, Yue-Li Hu et Feng Ran. « CQPSO scheduling algorithm for heterogeneous multi-core DAG task model ». Modern Physics Letters B 31, no 19-21 (27 juillet 2017) : 1740050. http://dx.doi.org/10.1142/s0217984917400504.
Texte intégralZhang, Jikai, Haidong Lan, Yuandong Chan, Yuan Shang, Bertil Schmidt et Weiguo Liu. « BGSA : a bit-parallel global sequence alignment toolkit for multi-core and many-core architectures ». Bioinformatics 35, no 13 (16 novembre 2018) : 2306–8. http://dx.doi.org/10.1093/bioinformatics/bty930.
Texte intégralHuang, Kai, Ming Jing, Xiaowen Jiang, Siheng Chen, Xiaobo Li, Wei Tao, Dongliang Xiong et Zhili Liu. « Task-Level Aware Scheduling of Energy-Constrained Applications on Heterogeneous Multi-Core System ». Electronics 9, no 12 (5 décembre 2020) : 2077. http://dx.doi.org/10.3390/electronics9122077.
Texte intégralVivanco, José María, Matthias Keinert, Armin Lechler et Alexander Verl. « Analysis and Design of Computerized Numerical Controls for Execution on Multi-core Systems ». Procedia CIRP 41 (2016) : 864–69. http://dx.doi.org/10.1016/j.procir.2015.12.021.
Texte intégralMuresano, Ronal, Hugo Meyer, Dolores Rexachs et Emilio Luque. « An approach for an efficient execution of SPMD applications on Multi-core environments ». Future Generation Computer Systems 66 (janvier 2017) : 11–26. http://dx.doi.org/10.1016/j.future.2016.06.016.
Texte intégralSesha Saiteja, Maddula N. V., K. Sai Sumanth Reddy, D. Radha et Minal Moharir. « Multi-Core Architecture and Network on Chip : Applications and Challenges ». Journal of Computational and Theoretical Nanoscience 17, no 1 (1 janvier 2020) : 239–45. http://dx.doi.org/10.1166/jctn.2020.8657.
Texte intégralChen, Kuo Yi, Fuh Gwo Chen et Jr Shian Chen. « A Cost-Effective Hardware Approach for Measuring Power Consumption of Modern Multi-Core Processors ». Applied Mechanics and Materials 110-116 (octobre 2011) : 4569–73. http://dx.doi.org/10.4028/www.scientific.net/amm.110-116.4569.
Texte intégralChen, Yong Heng, Wan Li Zuo et Feng Lin He. « Optimization Strategy of Bidirectional Join Enumeration in Multi-Core CPUS ». Applied Mechanics and Materials 44-47 (décembre 2010) : 383–87. http://dx.doi.org/10.4028/www.scientific.net/amm.44-47.383.
Texte intégralPark, Sihyeong, Mi-Young Kwon, Hoon-Kyu Kim et Hyungshin Kim. « Execution Model to Reduce the Interference of Shared Memory in ARINC 653 Compliant Multicore RTOS ». Applied Sciences 10, no 7 (3 avril 2020) : 2464. http://dx.doi.org/10.3390/app10072464.
Texte intégralSodinapalli, Nagendra Prasad, Subhash Kulkarni, Nawaz Ahmed Sharief et Prasanth Venkatareddy. « An efficient resource utilization technique for scheduling scientific workload in cloud computing environment ». IAES International Journal of Artificial Intelligence (IJ-AI) 11, no 1 (1 mars 2022) : 367. http://dx.doi.org/10.11591/ijai.v11.i1.pp367-378.
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