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Rajan, S. P., M. Fujita, K. Yuan et M. T.-C. Lee. « ATM switch design by high-level modeling, formal verification and high-level synthesi ». ACM Transactions on Design Automation of Electronic Systems 3, no 4 (octobre 1998) : 554–62. http://dx.doi.org/10.1145/296333.296342.
Texte intégralYang, Hae-Chan, Sang-Jun Park, Kwoan-Young Park, Jae-Hyun Sa et Tae-Hwan Kim. « High-level Synthesis Design and Implementation of an Efficient Capsule Network Inference System in an FPGA ». Journal of the Institute of Electronics and Information Engineers 58, no 11 (30 novembre 2021) : 39–47. http://dx.doi.org/10.5573/ieie.2021.58.11.39.
Texte intégralBolton, Martin. « High-level synthesis ». Microprocessors and Microsystems 18, no 8 (octobre 1994) : 489. http://dx.doi.org/10.1016/0141-9331(94)90097-3.
Texte intégralPawlak, Adam. « High-level synthesis ». Microprocessing and Microprogramming 35, no 1-5 (septembre 1992) : 261. http://dx.doi.org/10.1016/0165-6074(92)90325-2.
Texte intégralYAMAMOTO, Takahiro. « Safety assessment of high-level nuclear waste disposal in Japan from the standpoint of geology ». Synthesiology English edition 4, no 4 (2012) : 202–11. http://dx.doi.org/10.5571/syntheng.4.202.
Texte intégralRavi, Selvaraj, et M. Joseph. « High-Level Test Synthesis ». ACM Transactions on Design Automation of Electronic Systems 19, no 4 (août 2014) : 1–27. http://dx.doi.org/10.1145/2627754.
Texte intégralEwering, Christian, et Gunter Gerhardt. « PASS : High level synthesis ». Microprocessing and Microprogramming 30, no 1-5 (août 1990) : 103–8. http://dx.doi.org/10.1016/0165-6074(90)90225-x.
Texte intégralXing, Xianwu, et Ching Chuen Jong. « Floorplan-Driven Multivoltage High-Level Synthesis ». VLSI Design 2009 (6 septembre 2009) : 1–10. http://dx.doi.org/10.1155/2009/156751.
Texte intégralDossis, M. « High-level Synthesis Integrated Verification ». Engineering, Technology & ; Applied Science Research 5, no 5 (4 octobre 2015) : 864–70. http://dx.doi.org/10.48084/etasr.596.
Texte intégralGajski, D. D., et L. Ramachandran. « Introduction to high-level synthesis ». IEEE Design & ; Test of Computers 11, no 4 (1994) : 44–54. http://dx.doi.org/10.1109/54.329454.
Texte intégralPaulin, P. G., et J. P. Knight. « Algorithms for high-level synthesis ». IEEE Design & ; Test of Computers 6, no 6 (décembre 1989) : 18–31. http://dx.doi.org/10.1109/54.41671.
Texte intégralRosenstiel, Wolfgang. « Optimizations in high level synthesis ». Microprocessing and Microprogramming 18, no 1-5 (décembre 1986) : 347–52. http://dx.doi.org/10.1016/0165-6074(86)90063-3.
Texte intégralZhenyu Gu, Jia Wang, R. P. Dick et Hai Zhou. « Unified Incremental Physical-Level and High-Level Synthesis ». IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems 26, no 9 (septembre 2007) : 1576–88. http://dx.doi.org/10.1109/tcad.2007.895780.
Texte intégralVan Meerbergen, J. L., P. E. R. Lippens, W. F. J. Verhaegh et A. Van Der Werf. « PHIDEO : High-level synthesis for high throughput applications ». Journal of VLSI signal processing systems for signal, image and video technology 9, no 1-2 (janvier 1995) : 89–104. http://dx.doi.org/10.1007/bf02406472.
Texte intégralNishikawa, Hiroki, Kenta Shirane, Ryohei Nozaki, Ittetsu Taniguchi et Hiroyuki Tomiyama. « Function‐level module sharing techniques in high‐level synthesis ». ETRI Journal 42, no 4 (août 2020) : 527–33. http://dx.doi.org/10.4218/etrij.2020-0107.
Texte intégralZheng, Hongbin, Swathi T. Gurumani, Liwei Yang, Deming Chen et Kyle Rupnow. « High-Level Synthesis With Behavioral-Level Multicycle Path Analysis ». IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems 33, no 12 (décembre 2014) : 1832–45. http://dx.doi.org/10.1109/tcad.2014.2361661.
Texte intégralHerklotz, Yann, James D. Pollard, Nadesh Ramanathan et John Wickerson. « Formal verification of high-level synthesis ». Proceedings of the ACM on Programming Languages 5, OOPSLA (20 octobre 2021) : 1–30. http://dx.doi.org/10.1145/3485494.
Texte intégralLyuh, C. G., T. Kim et K. W. Kim. « Coupling-Aware High-Level Interconnect Synthesis ». IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems 23, no 1 (janvier 2004) : 157–64. http://dx.doi.org/10.1109/tcad.2003.819892.
Texte intégralKundu, Sudipta, Sorin Lerner et Rajesh K. Gupta. « Translation Validation of High-Level Synthesis ». IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems 29, no 4 (avril 2010) : 566–79. http://dx.doi.org/10.1109/tcad.2010.2042889.
Texte intégralCoussy, Philippe, et Andres Takach. « Special Issue on High-Level Synthesis ». IEEE Design & ; Test of Computers 25, no 5 (septembre 2008) : 393. http://dx.doi.org/10.1109/mdt.2008.147.
Texte intégralCoussy, P., D. D. Gajski, M. Meredith et A. Takach. « An Introduction to High-Level Synthesis ». IEEE Design & ; Test of Computers 26, no 4 (juillet 2009) : 8–17. http://dx.doi.org/10.1109/mdt.2009.69.
Texte intégralCoussy, Philippe, Ghizlane Lhairech-Lebreton et Dominique Heller. « Multiple Word-Length High-Level Synthesis ». EURASIP Journal on Embedded Systems 2008, no 1 (2008) : 916867. http://dx.doi.org/10.1155/2008/916867.
Texte intégralGeorgakakis, Spyridon, et John Evans. « Overview of high level synthesis tools ». Journal of Instrumentation 6, no 02 (18 février 2011) : C02005. http://dx.doi.org/10.1088/1748-0221/6/02/c02005.
Texte intégralPrihozhy, A. « Net scheduling in high-level synthesis ». IEEE Design & ; Test of Computers 13, no 1 (1996) : 26–35. http://dx.doi.org/10.1109/54.485780.
Texte intégralLin, Colin Yu, Zhenghong Jiang, Cheng Fu, Hayden Kwok-Hay So et Haigang Yang. « FPGA High-level Synthesis versus Overlay ». ACM SIGARCH Computer Architecture News 44, no 4 (11 janvier 2017) : 92–97. http://dx.doi.org/10.1145/3039902.3039919.
Texte intégralGhosh, Indradeep, et Niraj K. Jha. « High-level test synthesis : a survey ». Integration 26, no 1-2 (décembre 1998) : 79–99. http://dx.doi.org/10.1016/s0167-9260(98)00022-4.
Texte intégralIsmaeel, A. A., R. Bhatnagar et R. Mathew. « Concurrent testing in high level synthesis ». Microelectronics Reliability 40, no 12 (décembre 2000) : 2095–106. http://dx.doi.org/10.1016/s0026-2714(00)00028-7.
Texte intégralLakshminarayana, G., A. Raghunathan, N. K. Jha et S. Dey. « Power management in high-level synthesis ». IEEE Transactions on Very Large Scale Integration (VLSI) Systems 7, no 1 (mars 1999) : 7–15. http://dx.doi.org/10.1109/92.748195.
Texte intégralWinterstein, Felix J., Samuel R. Bayliss et George A. Constantinides. « Separation Logic for High-Level Synthesis ». ACM Transactions on Reconfigurable Technology and Systems 9, no 2 (3 février 2016) : 1–23. http://dx.doi.org/10.1145/2836169.
Texte intégralLin, Youn-Long. « Recent developments in high-level synthesis ». ACM Transactions on Design Automation of Electronic Systems 2, no 1 (janvier 1997) : 2–21. http://dx.doi.org/10.1145/250243.250245.
Texte intégralKeinprasit, Rachaporn, et Prabhas Chongstitvatana. « High-level synthesis by dynamic ant ». International Journal of Intelligent Systems 19, no 1-2 (janvier 2004) : 25–38. http://dx.doi.org/10.1002/int.10148.
Texte intégralTATSUOKA, Masato, et Mineo KANEKO. « High Level Congestion Detection from C/C++ Source Code for High Level Synthesis ». IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E103.A, no 12 (1 décembre 2020) : 1437–46. http://dx.doi.org/10.1587/transfun.2020vlp0012.
Texte intégralVerdier, François S., et Bertrand Zavidovique. « A High Level Synthesis System for VLSI Image Processing Applications ». VLSI Design 7, no 4 (1 janvier 1998) : 321–36. http://dx.doi.org/10.1155/1998/95421.
Texte intégralAytekin, Metin, Suzy A. A. Comhair, Carol de la Motte, Sudip K. Bandyopadhyay, Carol F. Farver, Vincent C. Hascall, Serpil C. Erzurum et Raed A. Dweik. « High levels of hyaluronan in idiopathic pulmonary arterial hypertension ». American Journal of Physiology-Lung Cellular and Molecular Physiology 295, no 5 (novembre 2008) : L789—L799. http://dx.doi.org/10.1152/ajplung.90306.2008.
Texte intégralPilászy, György, György Rácz et Péter Arató. « Communication Time Estimation in High Level Synthesis ». Periodica Polytechnica Electrical Engineering 57, no 4 (2013) : 99. http://dx.doi.org/10.3311/ppee.7413.
Texte intégralZhang, Zhiru, Deming Chen, Steve Dai et Keith Campbell. « High-level Synthesis for Low-power Design ». IPSJ Transactions on System LSI Design Methodology 8 (2015) : 12–25. http://dx.doi.org/10.2197/ipsjtsldm.8.12.
Texte intégralSu, Fei, et Krishnendu Chakrabarty. « High-level synthesis of digital microfluidic biochips ». ACM Journal on Emerging Technologies in Computing Systems 3, no 4 (janvier 2008) : 1–32. http://dx.doi.org/10.1145/1324177.1324178.
Texte intégralWang, W., A. Raghunathan, N. K. Jha et S. Dey. « Resource Budgeting for Multiprocess High-Level Synthesis ». IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems 23, no 7 (juillet 2004) : 1010–19. http://dx.doi.org/10.1109/tcad.2004.829806.
Texte intégralLin Zhong et N. K. Jha. « Interconnect-aware low-power high-level synthesis ». IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems 24, no 3 (mars 2005) : 336–51. http://dx.doi.org/10.1109/tcad.2004.842820.
Texte intégralAndriamisaina, Caaliph, Philippe Coussy, Emmanuel Casseau et Cyrille Chavet. « High-Level Synthesis for Designing Multimode Architectures ». IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems 29, no 11 (novembre 2010) : 1736–49. http://dx.doi.org/10.1109/tcad.2010.2062751.
Texte intégralLy, T. A., et J. T. Mowchenko. « Applying simulated evolution to high level synthesis ». IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems 12, no 3 (mars 1993) : 389–409. http://dx.doi.org/10.1109/43.215002.
Texte intégralMartin, G., et G. Smith. « High-Level Synthesis : Past, Present, and Future ». IEEE Design & ; Test of Computers 26, no 4 (juillet 2009) : 18–25. http://dx.doi.org/10.1109/mdt.2009.83.
Texte intégralSarkar, S., S. Dabral, P. K. Tiwari et R. S. Mitra. « Lessons and Experiences with High-Level Synthesis ». IEEE Design & ; Test of Computers 26, no 4 (juillet 2009) : 34–45. http://dx.doi.org/10.1109/mdt.2009.84.
Texte intégralYuan Xie et Yibo Chen. « Statistical High-Level Synthesis under Process Variability ». IEEE Design & ; Test of Computers 26, no 4 (juillet 2009) : 78–87. http://dx.doi.org/10.1109/mdt.2009.85.
Texte intégralRoy, J., N. Kumar, R. Dutta et R. Vemuri. « DSS : a distributed high-level synthesis system ». IEEE Design & ; Test of Computers 9, no 2 (juin 1992) : 18–32. http://dx.doi.org/10.1109/54.143143.
Texte intégralCamposano, R. « From behavior to structure : high-level synthesis ». IEEE Design & ; Test of Computers 7, no 5 (octobre 1990) : 8–19. http://dx.doi.org/10.1109/54.60603.
Texte intégralErnst, R., et J. Bhasker. « Simulation-based verification for high-level synthesis ». IEEE Design & ; Test of Computers 8, no 1 (mars 1991) : 14–20. http://dx.doi.org/10.1109/54.75659.
Texte intégralCamposano, R., L. F. Saunders et R. M. Tabet. « VHDL as input for high-level synthesis ». IEEE Design & ; Test of Computers 8, no 1 (mars 1991) : 43–49. http://dx.doi.org/10.1109/54.75662.
Texte intégralLavagno, Luciano. « What is ECO for high-level synthesis ? » ACM SIGDA Newsletter 39, no 12 (décembre 2009) : 1. http://dx.doi.org/10.1145/1862885.1862886.
Texte intégralBergamaschi, R. A., R. A. O'Connor, L. Stok, M. Z. Moricz, S. Prakash, A. Kuehlmann et D. S. Rao. « High-level synthesis in an industrial environment ». IBM Journal of Research and Development 39, no 1.2 (janvier 1995) : 131–48. http://dx.doi.org/10.1147/rd.391.0131.
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