Artículos de revistas sobre el tema "Digital logic circuits"
Crea una cita precisa en los estilos APA, MLA, Chicago, Harvard y otros
Consulte los 50 mejores artículos de revistas para su investigación sobre el tema "Digital logic circuits".
Junto a cada fuente en la lista de referencias hay un botón "Agregar a la bibliografía". Pulsa este botón, y generaremos automáticamente la referencia bibliográfica para la obra elegida en el estilo de cita que necesites: APA, MLA, Harvard, Vancouver, Chicago, etc.
También puede descargar el texto completo de la publicación académica en formato pdf y leer en línea su resumen siempre que esté disponible en los metadatos.
Explore artículos de revistas sobre una amplia variedad de disciplinas y organice su bibliografía correctamente.
Hasuo, S. y T. Imamura. "Digital logic circuits". Proceedings of the IEEE 77, n.º 8 (1989): 1177–93. http://dx.doi.org/10.1109/5.34118.
Texto completoDuncan, Philip N., Siavash Ahrar y Elliot E. Hui. "Scaling of pneumatic digital logic circuits". Lab on a Chip 15, n.º 5 (2015): 1360–65. http://dx.doi.org/10.1039/c4lc01048e.
Texto completoKamde, Shilpa, Jitesh Shinde, Sanjay Badjate y Pratik Hajare. "Comparative Analysis Domino Logic Based Techniques For VLSI Circuit". INTERNATIONAL JOURNAL OF COMPUTERS & TECHNOLOGY 12, n.º 8 (21 de marzo de 2014): 3803–8. http://dx.doi.org/10.24297/ijct.v12i8.2998.
Texto completoHou, Yue Wei, Xin Xu, Wei Wang, Xiao Bo Tian y Hai Jun Liu. "Titanium Oxide Memristor Based Digital Encoder Circuit". Applied Mechanics and Materials 644-650 (septiembre de 2014): 3430–33. http://dx.doi.org/10.4028/www.scientific.net/amm.644-650.3430.
Texto completoRaman, Karthik y Andreas Wagner. "The evolvability of programmable hardware". Journal of The Royal Society Interface 8, n.º 55 (9 de junio de 2010): 269–81. http://dx.doi.org/10.1098/rsif.2010.0212.
Texto completoDokic, B. L. "A Review on Energy Efficient CMOS Digital Logic". Engineering, Technology & Applied Science Research 3, n.º 6 (18 de diciembre de 2013): 552–61. http://dx.doi.org/10.48084/etasr.389.
Texto completoAvdeev, N. A. y P. N. Bibilo. "Design of Digital Operational Units with Low Power Consumption". Programmnaya Ingeneria 12, n.º 2 (16 de marzo de 2021): 63–73. http://dx.doi.org/10.17587/prin.12.63-73.
Texto completoJóźwiak, Lech. "General Decomposition and Its Use in Digital Circuit Synthesis". VLSI Design 3, n.º 3-4 (1 de enero de 1995): 225–48. http://dx.doi.org/10.1155/1995/16259.
Texto completoShukla, Vandana, O. P. Singh, G. R. Mishra y R. K. Tiwari. "Design and Implementation of Four Bit Binary Shifter Circuit Using Reversible Logic Approach". International Journal of Reconfigurable and Embedded Systems (IJRES) 4, n.º 3 (1 de noviembre de 2015): 213. http://dx.doi.org/10.11591/ijres.v4.i3.pp213-218.
Texto completoŽemva, Andrej, Andrej Trost y Baldomir Zajc. "Educational Programmable System for Prototyping Digital Circuits". International Journal of Electrical Engineering & Education 35, n.º 3 (julio de 1998): 236–44. http://dx.doi.org/10.1177/002072099803500306.
Texto completoSaman, B., R. H. Gudlavalleti, R. Mays, J. Chandy, Evan Heller y F. Jain. "3-Bit Analog-to-Digital Converter Using Multi-State Spatial Wave-Function Switched FETs". International Journal of High Speed Electronics and Systems 29, n.º 01n04 (marzo de 2020): 2040014. http://dx.doi.org/10.1142/s0129156420400145.
Texto completoSanthi, C. y Dr Moparthy Gurunadha Babu. "Symmetric stacked fast binary counters based on reversible logic". International Journal of Engineering & Technology 7, n.º 4 (6 de octubre de 2018): 2747. http://dx.doi.org/10.14419/ijet.v7i4.14141.
Texto completoGaladima, B. Y., G. S. M. Galadanci, A. Tijjani y M. Ibrahim. "A review on reversible logic gates". Bayero Journal of Pure and Applied Sciences 12, n.º 1 (15 de abril de 2020): 242–50. http://dx.doi.org/10.4314/bajopas.v12i1.38s.
Texto completoY. N., Sharath Kumar y Dinesha P. "TFI-FTS: An efficient transient fault injection and fault-tolerant system for asynchronous circuits on FPGA platform". International Journal of Electrical and Computer Engineering (IJECE) 11, n.º 3 (1 de junio de 2021): 2704. http://dx.doi.org/10.11591/ijece.v11i3.pp2704-2710.
Texto completoAl-Rabadi, Anas. "Three-dimensional lattice logic circuits, Part I: Fundamentals". Facta universitatis - series: Electronics and Energetics 18, n.º 1 (2005): 1–13. http://dx.doi.org/10.2298/fuee0501001a.
Texto completoLin, Shan, Tao Lin y Zhan Wen Liu. "A Discussion of the Design Method of Full Adder Circuit". Applied Mechanics and Materials 135-136 (octubre de 2011): 15–20. http://dx.doi.org/10.4028/www.scientific.net/amm.135-136.15.
Texto completoHossain, M., M. P. Singh y J. K. Rakshit. "Modelling of one-bit Arithmetic Logic Circuit using silicon micro-ring resonator". Journal of Physics: Conference Series 2335, n.º 1 (1 de septiembre de 2022): 012003. http://dx.doi.org/10.1088/1742-6596/2335/1/012003.
Texto completoWang, Lu, Hongyu Zhu, Ze Zuo y Dianzhong Wen. "Full-function logic circuit based on egg albumen resistive memory". Applied Physics Letters 121, n.º 24 (12 de diciembre de 2022): 243505. http://dx.doi.org/10.1063/5.0124826.
Texto completoFerreira Pontes, Matheus, Clayton Farias, Rafael Schvittz, Paulo Butzen y Leomar Da Rosa Jr. "Survey on Reliability Estimation in Digital Circuits". Journal of Integrated Circuits and Systems 16, n.º 3 (31 de diciembre de 2021): 1–11. http://dx.doi.org/10.29292/jics.v16i3.568.
Texto completoLi, Hongtao, Chunbiao Li, Zeshi Yuan, Wen Hu y Xiaochen Zhen. "A New Class of Chaotic Circuit with Logic Elements". Journal of Circuits, Systems and Computers 24, n.º 09 (27 de agosto de 2015): 1550136. http://dx.doi.org/10.1142/s0218126615501364.
Texto completoSimonetta, Alessandro y Maria Cristina Paoletti. "Designing Digital Circuits in Multi-Valued Logic". International Journal on Advanced Science, Engineering and Information Technology 8, n.º 4 (31 de julio de 2018): 1166. http://dx.doi.org/10.18517/ijaseit.8.4.5966.
Texto completoHauser, J. R. "Noise margin criteria for digital logic circuits". IEEE Transactions on Education 36, n.º 4 (1993): 363–68. http://dx.doi.org/10.1109/13.241612.
Texto completoShukla, Vandana, O. P. Singh, G. R. Mishra y R. K. Tiwari. "A Novel Approach to Design a 4-Bit Binary Comparator Circuit with Reversible Logic using CDSM Gate". International Journal of Business Data Communications and Networking 11, n.º 1 (enero de 2015): 36–49. http://dx.doi.org/10.4018/ijbdcn.2015010104.
Texto completoBROCK, DARREN K. "RSFQ TECHNOLOGY: CIRCUITS AND SYSTEMS". International Journal of High Speed Electronics and Systems 11, n.º 01 (marzo de 2001): 307–62. http://dx.doi.org/10.1142/s0129156401000861.
Texto completoHuang, Mingqiang, Xingli Wang, Guangchao Zhao, Philippe Coquet y Bengkang Tay. "Design and Implementation of Ternary Logic Integrated Circuits by Using Novel Two-Dimensional Materials". Applied Sciences 9, n.º 20 (9 de octubre de 2019): 4212. http://dx.doi.org/10.3390/app9204212.
Texto completoWang, Zicheng, Zijie Cai, Zhonghua Sun, Jian Ai, Yanfeng Wang y Guangzhao Cui. "Research of Molecule Logic Circuit Based on DNA Strand Displacement Reaction". Journal of Computational and Theoretical Nanoscience 13, n.º 10 (1 de octubre de 2016): 7684–91. http://dx.doi.org/10.1166/jctn.2016.5194.
Texto completoNaveenkumar, Majety. "Novel Design of Reversible MUX and DEMUX using GDI Techinque". International Journal of Advances in Applied Sciences 4, n.º 3 (1 de septiembre de 2015): 103. http://dx.doi.org/10.11591/ijaas.v4.i3.pp103-108.
Texto completoFadaei, Mohammadreza. "Designing ALU using GDI method". International Journal of Reconfigurable and Embedded Systems (IJRES) 8, n.º 3 (1 de noviembre de 2019): 151. http://dx.doi.org/10.11591/ijres.v8.i3.pp151-161.
Texto completoDilshad, Sk, Gannu Akhil, Simhadri RajaNandini, Javeria Unissa y Pulapakori Yadav Chandu. "Design and Implementation of Seven Segment Display Using Reversible Logic Gates". International Journal for Research in Applied Science and Engineering Technology 10, n.º 11 (30 de noviembre de 2022): 1500–1504. http://dx.doi.org/10.22214/ijraset.2022.47523.
Texto completoKumaresan, Raja Sekar, Marshal Raj y Lakshminarayanan Gopalakrishnan. "Design and implementation of a nano magnetic logic barrel shifter using beyond-CMOS technology". Journal of Electrical Engineering 73, n.º 1 (1 de febrero de 2022): 1–10. http://dx.doi.org/10.2478/jee-2022-0001.
Texto completoLIU, YUYU, JINGUO QUAN, HUAZHONG YANG y HUI WANG. "MOS CURRENT MODE LOGIC CIRCUITS: DESIGN CONSIDERATION IN HIGH-SPEED LOW-POWER APPLICATIONS AND ITS FUTURE TREND, A TUTORIAL". International Journal of High Speed Electronics and Systems 15, n.º 03 (septiembre de 2005): 599–614. http://dx.doi.org/10.1142/s0129156405003351.
Texto completoMOORE, PHILLIP W. y GANESH K. VENAYAGAMOORTHY. "EVOLVING DIGITAL CIRCUITS USING HYBRID PARTICLE SWARM OPTIMIZATION AND DIFFERENTIAL EVOLUTION". International Journal of Neural Systems 16, n.º 03 (junio de 2006): 163–77. http://dx.doi.org/10.1142/s0129065706000585.
Texto completoTyurin, S. F., A. Yu Skornyakova, Y. A. Stepchenkov y Y. G. Diachenko. "SELF-TIMED LOOK UP TABLE FOR ULAs AND FPGAs". Radio Electronics, Computer Science, Control 1, n.º 1 (24 de marzo de 2021): 36–45. http://dx.doi.org/10.15588/1607-3274-2021-1-4.
Texto completoSharmila Devi, S. y V. Bhanumathi. "Reversible Logic Based MOS Current Mode Logic Implementation in Digital Circuits". Computers, Materials & Continua 70, n.º 2 (2022): 3609–24. http://dx.doi.org/10.32604/cmc.2022.020426.
Texto completoRamsay, E. P., D. T. Clark, J. D. Cormack, A. E. Murphy, D. A. Smith, R. F. Thompson, R. A. R. Young y S. Finney. "Digital and Analogue Integrated Circuits in Silicon Carbide for High Temperature Operation". Additional Conferences (Device Packaging, HiTEC, HiTEN, and CICMT) 2012, HITEC (1 de enero de 2012): 000373–77. http://dx.doi.org/10.4071/hitec-thp11.
Texto completoAssaf, Mansour, Leslie-Ann Moore, Sunil Das, Satyendra Biswas y Scott Morton. "Low-level logic fault testing ASIC simulation environment". World Journal of Engineering 11, n.º 3 (1 de junio de 2014): 279–86. http://dx.doi.org/10.1260/1708-5284.11.3.279.
Texto completoBhoi, Bandan Kumar, Nirupma Pathak, Santosh Kumar y Neeraj Kumar Misra. "Designing digital circuits using 3D nanomagnetic logic architectures". Journal of Computational Electronics 20, n.º 3 (5 de febrero de 2021): 1310–25. http://dx.doi.org/10.1007/s10825-020-01647-7.
Texto completoMilter, O. y A. Kolodny. "Crosstalk noise reduction in synthesized digital logic circuits". IEEE Transactions on Very Large Scale Integration (VLSI) Systems 11, n.º 6 (diciembre de 2003): 1153–58. http://dx.doi.org/10.1109/tvlsi.2003.817551.
Texto completoHajj, I. N. y I. N. D. Saab. "Switch-Level Logic Simulation of Digital Bipolar Circuits". IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems 6, n.º 2 (marzo de 1987): 251–58. http://dx.doi.org/10.1109/tcad.1987.1270269.
Texto completoGoñi-Moreno, Angel. "On genetic logic circuits: forcing digital electronics standards?" Memetic Computing 6, n.º 3 (21 de junio de 2014): 149–55. http://dx.doi.org/10.1007/s12293-014-0136-8.
Texto completoFalkowski, Bogdan J. "Spectral Testing of Digital Circuits". VLSI Design 14, n.º 1 (1 de enero de 2002): 83–105. http://dx.doi.org/10.1080/10655140290009828.
Texto completoXu, Haoran, Jianghua Ding y Jian Dang. "Design and Characteristics of CMOS Inverter based on Multisim and Cadence". Journal of Physics: Conference Series 2108, n.º 1 (1 de noviembre de 2021): 012034. http://dx.doi.org/10.1088/1742-6596/2108/1/012034.
Texto completoChen, Ling y Zhong Liang Pan. "Fault Detection of Bridging Faults in Digital Circuits by Shared Binary Decision Diagram". Key Engineering Materials 439-440 (junio de 2010): 1235–40. http://dx.doi.org/10.4028/www.scientific.net/kem.439-440.1235.
Texto completoGavrilenkov, Sergey I., Elizaveta O. Petrenko y Evgeny V. Arbuzov. "A Digital Device for Automatic Checking of Homework Assignments in the Digital Circuits Course". ITM Web of Conferences 35 (2020): 04009. http://dx.doi.org/10.1051/itmconf/20203504009.
Texto completoHudli, Anand V. y Raghu V. Hudli. "Temporal Logic Based Hierarchical Test Generation for Sequential VLSI Circuits". VLSI Design 2, n.º 1 (1 de enero de 1994): 69–80. http://dx.doi.org/10.1155/1994/94514.
Texto completoKumagai, Masaaki y Takashi Emura. "Development of a Universal Interface Board and its Application to Robot Controllers and Signal Processors". Journal of Robotics and Mechatronics 16, n.º 2 (20 de abril de 2004): 200–207. http://dx.doi.org/10.20965/jrm.2004.p0200.
Texto completoMuñoz-Quijada, Maria, Samuel Sanchez-Barea, Daniel Vela-Calderon y Hipolito Guzman-Miranda. "Fine-Grain Circuit Hardening Through VHDL Datatype Substitution". Electronics 8, n.º 1 (25 de diciembre de 2018): 24. http://dx.doi.org/10.3390/electronics8010024.
Texto completoChandna, A., R. B. Brown, D. Putti y C. D. Kibler. "Power rail logic: a low power logic style for digital GaAs circuits". IEEE Journal of Solid-State Circuits 30, n.º 10 (1995): 1096–100. http://dx.doi.org/10.1109/4.466073.
Texto completoZhongliang, Pan, Chen Ling y Chen Yihui. "Determining Equivalent Signal Lines by Weight Value Assignment for Logic Verification of Digital Circuits". Open Electrical & Electronic Engineering Journal 8, n.º 1 (16 de septiembre de 2014): 104–10. http://dx.doi.org/10.2174/1874129001408010104.
Texto completoXu, Xingjian, Tian Ban y Yuehua Li. "SPLM: A Flexible and Accurate Reliability Assessment Model for Logic Circuits". Journal of Circuits, Systems and Computers 28, n.º 02 (12 de noviembre de 2018): 1950032. http://dx.doi.org/10.1142/s0218126619500324.
Texto completo