Literatura académica sobre el tema "Architecture matérielle et logicielle"
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Artículos de revistas sobre el tema "Architecture matérielle et logicielle"
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Aygalinc, P. y S. Calvez. "Cible p-Soc pour l’apprentissage de Linux en DUT GEII". J3eA 18 (2019): 1008. http://dx.doi.org/10.1051/j3ea/20191008.
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Les systèmes embarqués modernes utilisent souvent comme système d’exploitation Linux. Pour le DUT GEii, les architectures p-Soc (programmable-Systemonchip) trouvent grandement leur intérêt car elles permettent, en plus de l’apprentissage de ce système sur ses deux niveaux (user/kernel), d’entretenir et d’enrichir les connaissances acquises sur la description matérielle et l’informatique industrielle bas niveau. L’expérience menée ici décrit la plateforme développée dans ce cadre afin d’aborder d’une part les objectifs d’un système d’exploitation et de ses propriétés pour le développement d’applications de contrôle/commande en mode user, et d’autre part la conception de pilotes de périphériques du mode kernel sur des composants custom décrit en VHDL. Cet article traite aussi des prérequis nécessaires ainsi que des moyens indispensables à mettre en oeuvre par l’enseignant pour la mise en place de cet enseignement (prototypage rapide aussi bien au niveau matériel que logiciel).
2
Bigué, L. y M. Hassenforder. "Lecteur de codes à barres : approche matérielle et logicielle unifiée". J3eA 4 (2005): 024. http://dx.doi.org/10.1051/bib-j3ea:2005724.
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3
Werling, L., E. Dervieux, M. Madec y W. Uhring. "TD d’architecture matérielle : introduction aux architectures des microcontrôleurs". J3eA 23 (2024): 1021. http://dx.doi.org/10.1051/j3ea/20241021.
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Cet article décrit un TD d’introduction aux architectures des microcontrôleurs réalisé avec les étudiants de Télécom Physique Strasbourg en première année du cycle de formation ingénieur (BAC + 3) en spécialisation « Informatique et Réseaux ». Il vise à introduire les concepts fondamentaux de l’architecture des microcontrôleurs sur un exemple concret, en l’occurrence la réalisation d’un microcontrôleur élémentaire à l’aide du logiciel LOGISIM. Les travaux dirigés se déroulent sur 4 séances au cours desquelles les étudiants mettent en œuvre un microcontrôleur 6 bits qu’ils devront ensuite programmer en assembleur.
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Ait Said, N., M. Benabdenbi y G. Villanova Magalhães. "Prototypage Matériel-Logiciel de Systèmes Intégrés avec l'architecture RISC-V". J3eA 18 (2019): 1016. http://dx.doi.org/10.1051/j3ea/20191016.
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Cet article présente un nouvel enseignement en cours de mise en place à Grenoble INP dont l'objectif est de former les étudiants à la conception conjointe matérielle-logicielle de systèmes intégrés. L'objectif principal de ce nouvel enseignement est de donner à l'étudiant une vision plus claire de l'interaction entre le matériel et le logiciel et de l'impact d'un changement de l'un sur l'autre. La plateforme utilisée est libre de droit (Rocket Chip développée à Berkeley), elle est basée sur l'utilisation d'un processeur récent, d’architecture RISC-V et elle permet de faire du prototypage rapide et/ou d'aller jusqu'à l'implémentation physique sur FPGA ou ASIC. Cette flexibilité en fait un bon candidat comme outil pédagogique.
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Josso-Laurain, Thomas, Jonathan Ledy, Frédéric Fondement, Sébastien Bindel, Frédéric Drouhin, Françoise Simon y Michel Basset. "Transformer le campus universitaire en laboratoire ouvert : le projet SMART-UHA". J3eA 21 (2022): 0001. http://dx.doi.org/10.1051/j3ea/20220001.
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Ce papier décrit la méthodologie permettant de transformer un campus universitaire en laboratoire ouvert par l’introduction de plateformes expérimentales liées aux thématiques phares de la mobilité, de l’énergie et des mutations sociétales. En particulier, ce papier s’intéressera au volet Mobilité avec la présentation du robot SMART-UHA, un robot mobile autonome tracté par énergie électrique et dont les missions sont d’assurer des livraisons de colis sur le campus, et ce en assurant la totale sécurité des usagers. L’ensemble des capteurs et actionneurs de cette plateforme sont présentés, ainsi que les architectures matérielles et logicielles permettant une navigation sûre le long du campus. L’utilisation de cette plateforme dans le cadre de la formation des futurs techniciens et ingénieurs est détaillée, illustrant l’intérêt du robot SMART-UHA comme démonstrateur du savoir-faire de l’Université de Haute-Alsace et des interactions fortes entre recherche et enseignement.
6
Kofman, Daniel y Francis Jutand. "Introduction". Annales des Mines - Enjeux numériques 27, n.º 3 (27 de septiembre de 2024): 6–9. http://dx.doi.org/10.3917/ennu.027.0006.
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Les évolutions technologiques rapides et disruptives provoquent des transformations structurelles des infrastructures numériques et ouvrent de multiples opportunités pour l’ensemble des secteurs d’activité, dont l’émergence de nouveaux paradigmes de services et d’applications.Le développement d’une vision stratégique et la prise de décisions informées requièrent de comprendre à la fois les évolutions des technologies, celles des infrastructures matérielles et logicielles sous-jacentes, ainsi que les nouvelles architectures fonctionnelles et applicatives qu’elles suscitent.Ces transformations doivent être envisagées de manière holistique avec celles de la sécurité et de la sûreté, de l’impact environnemental et de l’acceptabilité sociale. L’évolution induite sur la géographie des filières doit être analysée, en intégrant les bouleversements géoéconomiques et géopolitiques, notamment dans un objectif de plus en plus pressant de souveraineté.Ces concepts ont fourni le fil conducteur pour la conception et la rédaction de ce numéro spécial, qui nous l’espérons apportera des éléments pour construire une vision d’ensemble du domaine, de ces enjeux et de ces challenges.
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Latreche, Sihem y Leila Sriti. "Optimisation énergétique d’un bâtiment résidentiel autoproduite à Biskra à travers ses caractéristiques matérielles". Journal of Renewable Energies 21, n.º 3 (30 de septiembre de 2018): 433–43. http://dx.doi.org/10.54966/jreen.v21i3.702.
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Le secteur résidentiel en Algérie est responsable de 41 % de la consommation totale d’électricité au niveau national et il représente, de fait, le secteur le plus énergivore. Le présent travail est consacré à l’étude de la performance énergétique des bâtiments résidentiels à travers l’optimisation de l’enveloppe architecturale relativement à un climat chaud et aride. L’habitat individuel autoproduite à Biskra est choisi comme cas d’étude pour évaluer l’influence des paramètres propre à l’enveloppe(les murs, la toiture, les fenêtres, etc...) sur la consommation énergétique et le confort thermique. Des tests de simulation ont été effectués à l’aide du logiciel TRNSYS 17 durant la période de surchauffe. Plusieurs alternatives relatives aux caractéristiques de l’enveloppe de l’habitat individuel autoproduit à Biskra ont été étudiées, l’objectif étant d’améliorer les conditions de confort thermique à l’intérieur des maisons tout en réduisant la consommation énergétique.
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Dadouche, F. y W. Uhring. "Enseignement par la pratique de la conception conjointe Hard/Soft de systèmes numériques embarqués sur cible FPGA". J3eA 21 (2022): 1018. http://dx.doi.org/10.1051/j3ea/20221018.
Texto completoResumen
Ce travail a pour but de partager une expérience d’enseignement dédiée à la conception de systèmes numériques embarqués sur cibles reconfigurables de type FPGA en première année de master au sein de l’université de Strasbourg. Cette dernière introduit une méthode d’apprentissage des concepts de la conception conjointe matérielle/logicielle (Hard/Soft) par la pratique. Dans cette méthode, la proportion des enseignements théoriques en cours magistraux est réduite au strict minimum pour laisser place aux travaux pratiques durant lesquels les étudiants sont confrontés à une situation réelle qu’ils doivent réaliser de manière individuelle dans le cadre d’un mini-projet. Ce dernier définit un seuil minimum de réalisation pour valider le projet, pour aller plus loin, des pistes d’amélioration sont suggérées par l’enseignant et au-delà les étudiants peuvent proposer leurs propres améliorations. Les retours, que nous avons eus, montrent que les étudiants sont très satisfaits de ce dispositif et souvent souhaitent la généralisation de la méthode à d’autres enseignements adaptés à un apprentissage par la pratique.
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Sondi, Patrick. "Enseignement des modules Architecture-Systèmes-Réseaux en Licence Informatique à l’ère des objets connectés: plébiscite de l’apprentissage par problème ?" J3eA 21 (2022): 2027. http://dx.doi.org/10.1051/j3ea/20222027.
Texto completoResumen
La Licence Informatique est un diplôme en plein questionnement sur son contenu et ses missions. L’essor des outils d’aide à la décision dopés par l’intelligence artificielle et la 5G qui a accéléré la virtualisation et la logicielisation des infrastructures pour l’Internet ouvrent de nouvelles compétences. A cela s’ajoutent diverses mutations : les méthodologies agiles en génie logiciel, la réalité augmentée dans les interactions homme-machine, les données massives dans les bases de données et enfin la généralisation du Web et des applications mobiles. Autant de pressions sur un programme de formation déjà mis à mal par la pluralité de métiers pour lesquels la Licence Informatique doit fournir un socle commun de connaissances au niveau national (futurs chercheurs, professionnels qualifiés, etc). Face aux moyens (volumes horaires, matériels, salles adaptées) devenus insuffisants pour former efficacement à autant d’innovations, une alternative à la fatalité réside dans les approches pédagogiques. A travers cet article, je partage une expérience personnelle sur une approche qui combine un enseignement classique afin de garantir la transmission des notions clés identifiées dans le programme, d’une part avec des travaux dirigés et pratiques construits selon l’approche de l’apprentissage par problème (APP), d’autre part. Un sondage par formulaire individuel et anonyme a permis de recueillir les impressions d’un échantillon représentatif d’étudiants en dernière année de Licence. L’article propose ainsi les données brutes relatives à ce retour afin que chacun en tire ses enseignements, face à l’analyse que j’en propose.
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BOCQUIER, F., N. DEBUS, A. LURETTE, C. MATON, G. VIUDES, C. H. MOULIN y M. JOUVEN. "Elevage de précision en systèmes d’élevage peu intensifiés". INRAE Productions Animales 27, n.º 2 (2 de junio de 2014): 101–12. http://dx.doi.org/10.20870/productions-animales.2014.27.2.3058.
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Les fortes contraintes d’élevage dans les systèmes peu intensifiés (grands troupeaux, larges surfaces, alimentation au pâturage, voire faible productivité par animal) laissent tout de même entrevoir des formes originales d’élevage de précision. Cet élevage de précision peut notamment s’appuyer sur l’identification électronique des animaux qui permet de les reconnaitre et de les localiser. Selon que les lecteurs d’identifiants sont utilisés manuellement, à poste fixe, ou portés par un mâle, il est possible de réaliser, respectivement, des inventaires, des opérations automatisées de tri ou la détection des femelles en chaleurs. C’est au pâturage que la maîtrise du comportement des animaux est la plus délicate car un positionnement judicieux de points d’attraction des animaux (abreuvement, pierres à sel, complémentation) ne suffit pas toujours à maîtriser la répartition de la pression de pâturage pour répondre aux objectifs pastoraux et environnementaux. Dans les situations où la pose de clôtures fixes n’est pas possible ou pas souhaitable et que le gardiennage n’est pas envisageable, les clôtures virtuelles, basées sur un apprentissage comportemental spécifique des animaux, pourraient constituer une aide précieuse à l’utilisation durable des parcours. Dans ces systèmes d’élevage, la précision visée ne se situe pas à l’échelle des individus mais plutôt sur des conduites ajustées à des lots virtuels d’animaux homogènes, qui sont séparés et regroupés grâce à des dispositifs de tri efficaces. L’utilisation de systèmes automatisés de suivi du troupeau où chaque animal est identifié génère une grande quantité de données. Quels que soient les capteurs utilisés, les données recueillies doivent être stockées dans un système d’information et traitées avec des méthodes d’analyse adaptées (algorithmes, statistiques…) pour être ensuite transformées en indicateurs d’aide à la décision ou en action exécutée par des automates (porte de tri, pesées, distributions d’aliments). En alternative à des suivis individuels, une utilisation parcimonieuse des capteurs peut être envisagée pour délivrer des alertes (intrusion, attaque de prédateur, sortie d’une zone géographique définie) ; la quantité de données produites est alors minimisée. Un travail de recherche important reste à mener pour proposer des méthodes d’analyse des données et des règles de décisions pertinentes, basées sur une modélisation du comportement animal. Dans les systèmes d’élevage peu intensifiés, la place de l’éleveur est essentielle car au sein d’un grand troupeau et face à de larges surfaces de parcours les dispositifs électroniques sont à envisager comme des aides spécifiques, à intégrer dans une stratégie de conduite plus large. Notamment, il s’agit pour l’éleveur de choisir quels animaux équiper et où positionner des capteurs, relais ou clôtures virtuelles, et à choisir de le faire aux périodes critiques. Actuellement l’offre matérielle et logicielle est freinée par le manque de souplesse des solutions proposées.
Tesis sobre el tema "Architecture matérielle et logicielle"
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Omar, Tariq Ali. "Une architecture mixte logicielle et matérielle pour le contrôle intelligent en temps réel". Grenoble INPG, 2006. http://www.theses.fr/2006INPG0089.
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Le Contrôle intelligente d'un système autonome dans un environnement dynamique et dangereux exige la capacité d'identifier les menaces d'échec et de planifier les réponses temps-réel qui peut assurer la sécurité et l'objectif du système autonome. Nous proposons une architecture pour le contrôle intelligent en temps-réel, appelée ORICA. Elle se compose d'un sous-système de raisonnement IA et d'un sous-système d'exécution temps-réel de réponse. Le sous-système de raisonnement modélise des caractéristiques temporelles et logiques du comportement environnemental et planifie les réponses du système. Le sous-système temps-réel, composé d'une partie logicielle et d'une partie matérielle, exécute ces réponses pour éviter l'échec du système autonome. Il donne une performance inégalée par rapport aux précédentes approches conventionnelles. Le comportement unique de l'intelligence reconfigurable est implanté dans la partie matérielle, avec un circuit logique reprogrammable (FPGA)Autonomous intelligent control system for a dynamic and dangerous environment necessitates the capacity to identify the failure threats and to plan the real-time responses that ensure safety and goal achievement by the autonomous system. We propose a real-time intelligent control architecture called ORICA. It consists of an AI reasoning subsystem and a real-time response execution subsystem. The AI reasoning subsystem models the temporal and logical characteristics of the environment and plans the system responses. The real-time subsystem, which is composed of a software section and a hardware section, executes these responses to avoid failure of the autonomous system. Its performance behavior is unparalleled by the previous classical approaches (pure hardware or pure software). The software section uses behavior switching according to the frequency of external events and a unique reconfigurable intelligence behavior has been implemented in hardware section, using a reprogrammable chip (FPGA)
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Maillot, Patrick. "Contribution à l'étude des systèmes graphiques : architectures logicielle et matérielle". Lyon 1, 1986. http://www.theses.fr/1986LYO19048.
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Le travail présenté ici s'appuie sur deux éléments : le premier, développé au laboratoire d'informatique Lyon 1, est constitué des logiciels graphiques PATK2D ET PATK3D qui ont servi de support aux solutions proposées en matière de logiciel. Le second élément est le terminal graphique TGI11XX, conçu par la Société SECAPA.
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Jordan, Harald. "Architectures logicielle et matérielle d'un contrôleur de robot multisensoriel : méthodologie et conception du système temps réel". Université Louis Pasteur (Strasbourg) (1971-2008), 1997. http://www.theses.fr/1997STR13155.
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Ce travail présente la méthodologie de développement d'un contrôleur de robot multisensoriel. Ce contrôleur se distingue par son ouverture, sa modularité et son évolutivité qui doivent permettre d'intégrer facilement de multiples capteurs intelligents et avancés. Notre approche consiste essentiellement dans une modélisation des besoins du contrôleur et ceci indépendamment de la réalisation matérielle. Après avoir défini les exigences du robot et de l'environnement vis-à-vis du contrôleur, nous avons choisi la méthode de modélisation Structured Analyses - Real-Time II (Hatley et Pirbhai 1991) qui nous a permis d'établir le modèle des besoins. Parmi les différentes architectures présentées dans la littérature, seule une architecture hiérarchique est adaptée pour répondre aux exigences prédéfinies. Nous avons ensuite retenu la notion des capteurs logiques (Henderson et Shilcrat 1984) que nous avons étendu afin de permettre de commander un système de capteurs extéroceptifs. Les interfaces du contrôleur sont, si possible, des standards existants. L'établissement du modèle des besoins s'est déroulé en deux étapes : le modèle pour un contrôleur minimal a été développé, ensuite nous avons étendu ce modèle à l'utilisation d'un système de vision. L'évaluation des modèles nous a demandé d'étendre la méthode SA-RT par l'utilisation des réseaux de Petri et des diagrammes d'activation de processus. Ces deux outils servent à vérifier la synchronisation des processus. L'estimation de puissance de calcul et des flux d'informations complète l'évaluation. Cette estimation a montré que l'implémentation du contrôleur minimal sur un ordinateur doté d'un processeur Pentium est possible. Nous avons ensuite établi les modèles d'architecture matérielle basés sur un tel ordinateur. Le développement de ces deux modèles suit celui des modèles des besoins : développement du modèle minimal et du modèle étendu.
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Koné, Chaka. "Architecture logicielle et matérielle d'un système de détection des émotions utilisant les signaux physiologiques. Application à la mnémothérapie musicale". Thesis, Université Côte d'Azur (ComUE), 2018. http://www.theses.fr/2018AZUR4042/document.
Texto completoResumen
Ce travail de thèse s’inscrit dans le domaine de l’informatique affective et plus précisément de l’intelligence artificielle et de l’exploration d’architecture. L’objectif de ce travail est de concevoir un système complet de détection des émotions en utilisant des signaux physiologiques. Ce travail se place donc à l’intersection de l’informatique pour la définition d’algorithme de détection des émotions et de l’électronique pour l’élaboration d’une méthodologie d’exploration d’architecture et pour la conception de nœuds de capteurs. Dans un premier temps, des algorithmes de détection multimodale et instantanée des émotions ont été définis. Deux algorithmes de classification KNN puis SVM, ont été implémentés et ont permis d’obtenir un taux de reconnaissance des émotions supérieurs à 80%. Afin de concevoir un tel système alimenté sur pile, un modèle analytique d’estimation de la consommation à haut niveau d’abstraction a été proposé et validé sur une plateforme réelle. Afin de tenir compte des contraintes utilisateurs, un outil de conception et de simulation d’architecture d’objets connectés pour la santé a été développé, permettant ainsi d’évaluer les performances des systèmes avant leur conception. Une architecture logicielle/matérielle pour la collecte et le traitement des données satisfaisant les contraintes applicatives et utilisateurs a ainsi été proposée. Doté de cette architecture, des expérimentations ont été menées pour la Mnémothérapie musicale. EMOTICA est un système complet de détection des émotions utilisant des signaux physiologiques satisfaisant les contraintes d’architecture, d’application et de l’utilisateurThis thesis work is part of the field of affective computing and more specifically artificial intelligence and architectural exploration. The goal of this work is to design a complete system of emotions detection using physiological signals. This work is therefore situated at the intersection of computer science for the definition of algorithm of detection of emotions and electronics for the development of an architecture exploration methodology for the design of sensor nodes. At first, algorithms for multimodal and instantaneous detection of emotions were defined. Two algorithms of classification KNN then SVM, were implemented and made it possible to obtain a recognition rate of the emotions higher than 80%. To design such a battery-powered system, an analytical model for estimating the power consumption at high level of abstraction has been proposed and validated on a real platform. To consider user constraints, a connected object architecture design and simulation tool for health has been developed, allowing the performance of systems to be evaluated prior to their design. Then, we used this tool to propose a hardware/software architecture for the collection and the processing of the data satisfying the architectural and applicative constraints. With this architecture, experiments have been conducted for musical Mnemotherapy. EMOTICA is a complete system for emotions detection using physiological signals satisfying the constraints of architecture, application and user
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Denoyelle, Nicolas. "De la localité logicielle à la localité matérielle sur les architectures à mémoire partagée, hétérogène et non-uniforme". Thesis, Bordeaux, 2018. http://www.theses.fr/2018BORD0201/document.
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La hiérarchie mémoire des serveurs de calcul est de plus en plus complexe. Les machines disposent de plusieurs niveaux de caches plus ou moins partagés et d’une mémoire distribuée. Plus récemment le paysage du Calcul Haute Performance (CHP) a vu apparaître des mémoires adressables embarquées dans le processeur ainsi que de nouvelles mémoires non-volatiles (périphérique mémoire sur le bus d’entrées sorties et prochainement de la mémoire non-volatile directement sur le bus mémoire). Cette hiérarchie est nécessaire pour espérer obtenir de bonnes performances de calcul, au prix d’une gestion minutieuse du placement des données et des tâches de calcul. Là où la gestion des caches était entièrement matérielle et masquée au développeur, le choix du placement des données dans telle ou telle zone de mémoire, plus ou moins rapide, volatile ou non, volumineuse ou non, est maintenant paramétrable logiciellement. Cette nouvelle flexibilité donne une grande liberté aux développeurs mais elle complexifie surtout leur travail quand il s’agit de choisir les stratégies d’allocation, de communication, de placement, etc. En effet, les caractéristiques des nombreux niveaux de hiérarchie impliqués varient significativement en vitesse, taille et fonctionnalités. Dans cette thèse, co-encadrée entre Atos Bull Technologies et Inria Bordeaux– Sud-Ouest, nous détaillons la structure des plates-formes contemporaines et caractérisons la performance des accès à la mémoire selon plusieurs scénarios de localité des tâches de calcul et des données accédées. Nous expliquons comment la sémantique du langage de programmation impacte la localité des données dans la machine et donc la performance des applications. En collaboration avec le laboratoire INESC-ID de Lisbonne, nous proposons une extension au célèbre modèle Roofline pour exposer de manière intelligible les compromis de performance et de localité aux développeurs d’applications. Nous proposons par ailleurs un outil de synthèse de métriques de localité mettant en lien les évènements de performance de l’application et de la machine avec la topologie de cette dernière. Enfin, nous proposons une approche statistique pour sélectionner automatiquement la meilleure politique de placement des tâches de calcul sur les coeurs de la machine et des données sur les mémoiresThrough years, the complexity of High Performance Computing (HPC) systems’ memory hierarchy has increased. Nowadays, large scale machines typically embed several levels of caches and a distributed memory. Recently, on-chip memories and non-volatile PCIe based flash have entered the HPC landscape. This memory architecture is a necessary pain to obtain high performance, but at the cost of a thorough task and data placement. Hardware managed caches used to hide the tedious locality optimizations. Now, data locality, in local or remote memories, in fast or slow memory, in volatile or non-volatile memory, with small or wide capacity, is entirely software manageable. This extra flexibility grants more freedom to application designers but with the drawback of making their work more complex and expensive. Indeed, when managing tasks and data placement, one has to account for several complex trade-offs between memory performance, size and features. This thesis has been supervised between Atos Bull Technologies and Inria Bordeaux – Sud-Ouest. In the hereby document, we detail contemporary HPC systems and characterize machines performance for several locality scenarios. We explain how the programming language semantics affects data locality in the hardware, and thus applications performance. Through a joint work with the INESC-ID laboratory in Lisbon, we propose an insightful extension to the famous Roofline performance model in order to provide locality hints and improve applications performance. We also present a modeling framework to map platform and application performance events to the hardware topology, in order to extract synthetic locality metrics. Finally, we propose an automatic locality policy selector, on top of machine learning algorithms, to easily improve applications tasks and data placement
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Njoyah, ntafam Perrin. "Méthodologie d'identification et d'évitement des cycles de gel du processeur pour l'optimisation de la performance du logiciel sur le matériel". Thesis, Université Grenoble Alpes (ComUE), 2018. http://www.theses.fr/2018GREAM021/document.
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L’un des objectifs de la microélectronique est de concevoir et fabriquer des SoCs de petites tailles, à moindre coût et visant des marchés tel que l’internet des objets. À matériel fixe sur lequel l’on ne dispose d’aucune marge de manœuvre, l’un des challenges pour un développeur de logiciels embarqués est d’écrire son programme de manière à ce qu’à l’exécution, le logiciel développé puisse utiliser au mieux les capacités de ces SoCs. Cependant, ces programmes n’utilisent pas toujours correctement les capacités de traitement disponibles sur le SoC. L’estimation et l’optimisation de la performance du logiciel devient donc une activité cruciale. A l’exécution, ces programmes sont très souvent victimes de l’apparition de cycles de gel de processeur dus à l’absence de données en mémoire cache. Il existe plusieurs approches permettant d’éviter ces cycles de gel de processeur. Par l’exemple l’utilisation des options de compilation adéquates pour la génération du meilleur code exécutable possible. Cependant les compilateurs n’ont qu’une idée abstraite (sous forme de formules analytiques) de l’architecture du matériel sur lequel le logiciel s’exécutera. Une alternative est l’utilisation des processeurs « Out–Of–Order ». Mais ces processeurs sont très couteux en terme de coût de fabrication car nécessites une surface de silicium importante pour l’implantation de ces mécanismes. Dans cette thèse, nous proposons une méthode itérative basée sur les plateformes virtuelles précises au niveau du cycle qui permet d’identifier les instructions du programme à optimiser responsables à l’exécution, de l’apparition des cycles de gel de processeur dus à l’absence de données dans le cache L1. L’objectif est de fournir au développeur des indices sur les emplacements du code source de son programme en langage de haut niveau (C/C++ typiquement) qui sont responsables de ces gels. Pour chacune de ces instructions, nous fournissons leur contribution au rallongement du temps d’exécution totale du programme. Finalement nous estimons le gain potentiel maximal qu’il est possible d’obtenir si tous les cycles de gel identifiés sont évités en insérant manuellement dans le code source du programme à optimiser, des instructions de pré–chargement de données dirigé par le logicielOne of microelectronics purposes is to design and manufacture small-sized, low-cost SoCs targeting markets such as the Internet of Things. With fixed hardware on which there is no possible flexibility, one of the challenges for an embedded software developer is to write his program so that, at runtime, the software developed can make the best use of these SoC capabilities. However, these programs do not always properly use the available SoC processing capabilities. Software performance estimation and optimization is then a crucial activity. At runtime, these programs are very often victims of processor data stall cycles. There are several approaches to avoiding these processor data stall cycles. For example, using the appropriate compilation options to generate the best executable code. However, the compilers have only an abstract knowledge (as analytical formulas) of the hardware architecture on which the software will be executed. Another way of solving this issue is to use Out-Of- Order processors. But these processors are very expensive in terms of manufacturing cost because they require a large silicon surface for the implementation of the Out-Of-Order mechanism. In this thesis, we propose an iterative methodology based on cycle accurate virtual platforms, which helps identifying precisely instructions of the program which are responsible of the generation of processor data stall cycles. The goal is to provide the developer with clues on the source code lignes of his program’s in high level language (C/C++ typically) which are responsible of these stalls. For each instructions, we provide their contribution to lengthening of the total program execution time. Finally, we estimate the maximum potential gain that can be achieved if all identified stall cycles are avoided by manually inserting software preloading instructions into the source code of the program to optimize
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Barrenscheen, Jens. "Commande économique d'un moteur synchrone à aimant permanent - architecture matérielle et logicielle - estimation de la position - modélisation dynamique au sens des systèmes échantillonnes". Paris 6, 1995. http://www.theses.fr/1995PA066516.
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Ce mémoire traite une commande numérique d'un moteur synchrone a aimant en vue d'une réalisation économique. L'utilisation des dispositifs de commande a faible coût nécessite une adéquation fine entre les structures algorithmiques et l'architecture matérielle pour conserver des performances satisfaisantes du moteur asservi en couple et en vitesse. Dans le but d'améliorer le rapport cout-performances du système, un algorithme original d'estimation de la position du rotor est propose. Cela permet de remplacer le capteur mécanique par un estimateur logiciel. La structure controle-estimation de la commande étudiée engendre une forte interaction entre les performances et la robustesse de l'asservissement d'une part et les paramètres des correcteurs d'autre part. Dans ce but, une modélisation fine au sens de petites variations a été developpee. Ce modèle permet de tenir compte du caractère échantillonne de la commande numérique et des discontinuités introduites par l'alimentation fonctionnant en mli. Le système étudie est donc non-lineaire et il comporte des grandeurs discrètes et des grandeurs continues dans le temps. En outre, l'échantillonnage est fait a fréquence variable. L'utilisation d'un algorithme de newton rend possible la détermination acceleree du régime permanent. L'utilisation des fonctions de sensibilité permet de décrire les propriétés dynamiques du système et de choisir les coefficients des correcteurs par placement de pôles
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Fiandino, Maxime. "Exploration d'architectures basée sur la génération automatique de plates-formes matérielles et le portage rapide du logiciel". Grenoble INPG, 2007. http://www.theses.fr/2007INPG0053.
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L’approche proposée se déroule selon un flot itératif en trois étapes. L’une concerne la modification et le développement rapide du modèle exécutable de l’architecture. Une autre vise le portage rapide des logiciels. La troisième est l’exploration d’architecture logicielle et matérielle. Un outil a été développé pour créer et modifier rapidement un HMPSoC à partir de sous-systèmes de traitement paramétrables. Une méthode permet d’adapter le logiciel sur une architecture, elle inclut: paramétrer manuellement le logiciel applicatif, l’extraction automatique des caractéristiques de l’architecture, la génération des sources de bas niveau. Enfin une méthode permet d’effectuer des simulations multi-niveaux des processeurs. Les simulations de haut niveau servent pour exécuter rapidement les logiciels embarqués, les simulations précises en mode bas niveau (ISS) pour mesurer les performances. Suivant les résultats, l’architecture et les logiciels sont modifiés et le cycle peut reprendreThe proposed approach is an iterative flow in three steps. The first one is the fast development and modification of the architecture executable model. The second one is the adaptation of the embedded software. The third one is the hardware and software architecture exploration. A tool has been developed in order to create and modify quickly a hardware architecture model. It uses flexible sub-systems. One method in order to adapt the embedded software is exposed, it includes: to manually add some parameterization in the software, an automatic extraction of the architecture characteristics, the generation of the low level code sources. To finish a method allow to simulate processors at different level of simulation with their embedded software, high level for fast simulation, low level for performance measurements. Following results, hardware and software are modified and the flow can restart. This flow was tested on a real application, a parallelized H264 encoder
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Vincke, Bastien. "Architectures pour des systèmes de localisation et de cartographie simultanées". Phd thesis, Université Paris Sud - Paris XI, 2012. http://tel.archives-ouvertes.fr/tel-00770323.
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La robotique mobile est un domaine en plein essor. L'un des domaines de recherche consiste à permettre à un robot de cartographier son environnement tout en se localisant dans l'espace. Les techniques couramment employées de SLAM (Simultaneous Localization And Mapping) restent généralement coûteuses en termes de puissance de calcul. La tendance actuelle vers la miniaturisation des systèmes impose de restreindre les ressources embarquées. L'ensemble de ces constatations nous ont guidés vers l'intégration d'algorithmes de SLAM sur des architectures adéquates dédiées pour l'embarqué.Les premiers travaux ont consisté à définir une architecture permettant à un robot mobile de se localiser. Cette architecture doit respecter certaines contraintes, notamment celle du temps réel, des dimensions réduites et de la faible consommation énergétique.L'implantation optimisée d'un algorithme (EKF-SLAM), en utilisant au mieux les spécificités architecturales du système (capacités des processeurs, implantation multi-cœurs, calcul vectoriel ou parallélisation sur architecture hétérogène), a permis de démontrer la possibilité de concevoir des systèmes embarqués pour les applications SLAM dans un contexte d'adéquation algorithme architecture. Une seconde approche a été explorée ayant pour objectif la définition d'un système à base d'une architecture reconfigurable (à base de FPGA) permettant la conception d'une architecture fortement parallèle dédiée au SLAM. L'architecture définie a été évaluée en utilisant une méthodologie HIL (Hardware in the Loop).Les principaux algorithmes de SLAM sont conçus autour de la théorie des probabilités, ils ne garantissent en aucun cas les résultats de localisation. Un algorithme de SLAM basé sur la théorie ensembliste a été défini garantissant l'ensemble des résultats obtenus. Plusieurs améliorations algorithmiques sont ensuite proposées. Une comparaison avec les algorithmes probabilistes a mis en avant la robustesse de l'approche ensembliste.Ces travaux de thèse mettent en avant deux contributions principales. La première consiste à affirmer l'importance d'une conception algorithme-architecture pour résoudre la problématique du SLAM. La seconde est la définition d'une méthode ensembliste permettant de garantir les résultats de localisation et de cartographie.
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Guerif, Benjamin. "Conception d’une sonde programmable, polyvalente et abordable pour l'imagerie médicale ultrasonore volumétrique en temps réel". Electronic Thesis or Diss., Université Paris sciences et lettres, 2024. http://www.theses.fr/2024UPSLS041.
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Selon l’Organisation Mondiale de la Santé, les maladies cardiovasculaires sont la principale cause de décès dans le monde avec 17.9 millions de décès soit 32% des morts constatés en 2019. L’échocardiographie transthoracique (TTE), une technique d’imagerie ultrasonore non invasive et non irradiante, s’est alors imposée comme un outil de diagnostic efficace permettant d’identifier les dysfonctionnements du muscle cardiaque. Cette technique permet alors de procéder à une analyse morphologique et cinétique du cœur à l’aide de techniques d’imagerie dites conventionnelles.D’autres techniques alternatives telles que l’imagerie ultrarapide proposent des modalités complémentaires pouvant permettre d’améliorer le diagnostic des maladies cardiovasculaires. Si ces techniques ont pu faire leurs preuves en imagerie bidimensionnelle (2D), différentes barrières technologiques s’opposent à sa démocratisation en imagerie tridimensionnelle (3D). En effet, le passage de la 2D à la 3D nécessite d’adresser des réseaux de transducteurs de plusieurs milliers de voies. Les systèmes d’imagerie cliniques ayant un nombre de voies limité (le plus souvent à 256), l’utilisation de techniques dites de réduction de voie s’avère donc nécessaire. L’une d’entre elles, appelée micro-formation de faisceau, s’est ainsi démarquée en proposant des performances d’imagerie conventionnelles 3D similaires à une sonde d’imagerie 2D. Cette technologie est le plus souvent fermé et semble a priori difficilement compatible avec des techniques d’imagerie alternative. Ce faisant l’imagerie ultrarapide s’est rapidement orientée sur des techniques de réduction de voie alternatives telles que les réseaux ligne-colonne, les réseaux clairsemés ou l’utilisation de systèmes d’imagerie encombrants avec des sondes matricielles de plus petite surface acoustique et composée de milliers d’éléments.Dans cette thèse, un premier travail visant à améliorer les techniques d’imagerie ultrarapide existantes est proposé en nous appuyant sur l’utilisation d’une nouvelle sonde complètement peuplée composée de 3072 éléments associée à nouveau système d’imagerie de plusieurs milliers de voies. Par la suite, la définition et l’étude d’une sonde matricielle active dédiée à l’imagerie TTE reposant sur l’utilisation de la micro-formation de faisceau et composée de plusieurs milliers d’éléments pilotés par un unique système d’imagerie est proposée. Enfin, un prototype de sonde de micro-formation de faisceau est réalisé et évalué expérimentalement à l’aide d’un échographe de recherche ouvert afin de proposer une première sonde suffisamment polyvalente, programmable et abordable pour rendre accessible cette technologies aux laboratoires de recherche et ainsi offrir de nouveaux outils de diagnostic en échocardiographie transthoracique 3DSelon l’Organisation Mondiale de la Santé, les maladies cardiovasculaires sont la principale cause de décès dans le monde avec 17.9 millions de décès soit 32% des morts constatés en 2019. L’échocardiographie transthoracique (TTE), une technique d’imagerie ultrasonore non invasive et non irradiante, s’est alors imposée comme un outil de diagnostic efficace permettant d’identifier les dysfonctionnements du muscle cardiaque. Cette technique permet alors de procéder à une analyse morphologique et cinétique du cœur à l’aide de techniques d’imagerie dites conventionnelles.D’autres techniques alternatives telles que l’imagerie ultrarapide proposent des modalités complémentaires pouvant permettre d’améliorer le diagnostic des maladies cardiovasculaires. Si ces techniques ont pu faire leurs preuves en imagerie bidimensionnelle (2D), différentes barrières technologiques s’opposent à sa démocratisation en imagerie tridimensionnelle (3D). En effet, le passage de la 2D à la 3D nécessite d’adresser des réseaux de transducteurs de plusieurs milliers de voies. Les systèmes d’imagerie cliniques ayant un nombre de voies limité (le plus souvent à 256), l’utilisation de techniques dites de réduction de voie s’avère donc nécessaire. L’une d’entre elles, appelée micro-formation de faisceau, s’est ainsi démarquée en proposant des performances d’imagerie conventionnelles 3D similaires à une sonde d’imagerie 2D. Cette technologie est le plus souvent fermé et semble a priori difficilement compatible avec des techniques d’imagerie alternative. Ce faisant l’imagerie ultrarapide s’est rapidement orientée sur des techniques de réduction de voie alternatives telles que les réseaux ligne-colonne, les réseaux clairsemés ou l’utilisation de systèmes d’imagerie encombrants avec des sondes matricielles de plus petite surface acoustique et composée de milliers d’éléments.Dans cette thèse, un premier travail visant à améliorer les techniques d’imagerie ultrarapide existantes est proposé en nous appuyant sur l’utilisation d’une nouvelle sonde complètement peuplée composée de 3072 éléments associée à nouveau système d’imagerie de plusieurs milliers de voies. Par la suite, la définition et l’étude d’une sonde matricielle active dédiée à l’imagerie TTE reposant sur l’utilisation de la micro-formation de faisceau et composée de plusieurs milliers d’éléments pilotés par un unique système d’imagerie est proposée. Enfin, un prototype de sonde de micro-formation de faisceau est réalisé et évalué expérimentalement à l’aide d’un échographe de recherche ouvert afin de proposer une première sonde suffisamment polyvalente, programmable et abordable pour rendre accessible cette technologies aux laboratoires de recherche et ainsi offrir de nouveaux outils de diagnostic en échocardiographie transthoracique 3D
Libros sobre el tema "Architecture matérielle et logicielle"
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Printz, Jacques. Architecture logicielle: Concevoir des applications simples, sûres et adaptables. Paris: Dunod, 2006.
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Alexis, Sornin, Jannière Hélène 1962- y Vanlaethem France, eds. Revues d'architecture dans les années 1960 et 1970: Fragments d'une histoire événementielle, intellectuelle et matérielle : actes du colloque international tenu les 6 et 7 mai 2004 au Centre canadien d'architecture, CCA, à Montréal. Montréal: Institut de recherche en histoire de l'architecture, 2008.
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3
Blackmore, Paul. Intranets: A guide to their design, implementation and management. London: Aslib imi, 2001.
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4
Schüller, Christian. Le micro : Architecture matérielle et logicielle. Ellipses-Marketing, 2000.
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5
Architecture matérielle et logicielle des ordinateurs et des microprocesseurs. Paris: Armand Colin, 1990.
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6
Fernandez, Jean-Charles, Fabienne Lagnier, Laurence Maraninchi y Pascal Sicard. Architectures logicielles et matérielles : Cours, études de cas et exercices corrigés. Dunod, 2000.
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7
Histoire matérielle du bâti et projet de sauvegarde: Devenir de l'architecture moderne et contemporaine. Lausanne: Presses polytechniques et universitaires romandes, 2014.
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8
Revues d'architecture dans les années 1960 et 1970: Fragments d'une histoire événementielle, intellectuelle et matérielle : actes du colloque international tenu les 6 et 7 mai 2004 au Centre canadien d'architecture, CCA, à Montréal. Montréal: Institut de recherche en histoire de l'architecture, 2008.
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Intranets: A Guide to Their Design, Implementation and Management. Taylor & Francis Group, 2023.
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Intranets: A Guide to Their Design, Implementation and Management. Taylor & Francis Group, 2003.
Buscar texto completoCapítulos de libros sobre el tema "Architecture matérielle et logicielle"
1
FALSAFI, Babak. "Architecture de serveur pour un centre de données post-Moore". En Systèmes multiprocesseurs sur puce 2, 159–72. ISTE Group, 2023. http://dx.doi.org/10.51926/iste.9022.ch6.
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L’émergence des centres de données est une réponse au changement de paradigme informatique vers l’informatique en nuage. Ce chapitre présente les approches récentes et prometteuses de la nouvelle conception logicielle/matérielle des serveurs des centres de données du futur, permettant d’intégrer l’hétérogénéité dans le silicium et facilitant la mise à l’échelle de plate-formes avec les matrices de réseau émergentes.
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DAVID, Raphaël, Étienne HAMELIN, Paul DUBRULLE, Shuai LI, Philippe DORE, Alexis OLIVEREAU, Maroun OJAIL, Alexandre CARBON y Laurent LE GARFF. "Plate-forme modulaire pour un environnement informatique de l’automobile du futur". En Systèmes multiprocesseurs sur puce 2, 125–57. ISTE Group, 2023. http://dx.doi.org/10.51926/iste.9022.ch5.
Texto completoResumen
Ce chapitre introduit une plate-forme matérielle opérant en temps réel et répondant aux défis de conception des architectures électriques et électroniques des véhicules intelligents de l’avenir. Grâce à la conception intégrée, et en se servant de logiciels et d’outils embarqués, les auteurs montrent la cohabitation efficace entre les applications à faible criticité et le logiciel opérationnel critique de la voiture.
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GAUTIER, Matthieu y Olivier BERDER. "Adaptation de la qualité de service dans les dispositifs IoT à récupération d’énergie". En La gestion et le contrôle intelligents des performances et de la sécurité dans l’IoT, 137–68. ISTE Group, 2022. http://dx.doi.org/10.51926/iste.9053.ch6.
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La récupération d’énergie est une technologie prometteuse pour augmenter la durée de vie des réseaux IoT, en permettant à chaque nœud d’être entièrement alimenté par l’énergie récupérée de son environnement. Pour être durable, chaque nœud doit adapter dynamiquement sa qualité de service en fonction de l’énergie récupérée. Ce chapitre aborde la conception logicielle et matérielle d’objets à récupération d’énergie.
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Sodini, Jean-Pierre. "LES APPORTS DES FOUILLES DU PÈRE MICHELE PICCIRILLO À LA CULTURE MATÉRIELLE DE L’ÉPOQUE PROTOBYZANTINE". En Architecture et décor dans l’Orient chrétien (IVe-VIIIe Siècle), 41–56. Editions de Boccard, 2016. http://dx.doi.org/10.2307/j.ctvbqs93n.4.
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Cayre, Émilie. "Circulation et architecture de passage : les propylées classiques et hellénistiques d’Asie Mineure". En Les ruines résonnent encore de leurs pas. La circulation matérielle et immatérielle dans les monuments grecs (VIIe s. – 31 a.C.), 31–61. Ausonius Éditions, 2021. http://dx.doi.org/10.46608/primaluna6.9782356133762.3.
Texto completoActas de conferencias sobre el tema "Architecture matérielle et logicielle"
1
Gain, Pascal. "Architectures matérielles et logicielles". En Simulateurs et réacteurs. Les Ulis, France: EDP Sciences, 2013. http://dx.doi.org/10.1051/jtsfen/2013sim09.
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