Zeitschriftenartikel zum Thema „Regular architecture“
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Trobec, Roman, Janez Korenini und Ludvik Gyergyek. „A regular WSI-node architecture“. Microprocessing and Microprogramming 21, Nr. 1-5 (August 1987): 75–81. http://dx.doi.org/10.1016/0165-6074(87)90021-4.
Der volle Inhalt der QuelleAntonov, Vadim G. „A regular architecture for operating system“. ACM SIGOPS Operating Systems Review 24, Nr. 3 (Juli 1990): 22–39. http://dx.doi.org/10.1145/382244.382830.
Der volle Inhalt der QuelleParravicini, Daniele, Davide Conficconi, Emanuele Del Sozzo, Christian Pilato und Marco D. Santambrogio. „CICERO: A Domain-Specific Architecture for Efficient Regular Expression Matching“. ACM Transactions on Embedded Computing Systems 20, Nr. 5s (31.10.2021): 1–24. http://dx.doi.org/10.1145/3476982.
Der volle Inhalt der QuelleKorotkiy, V. A., und E. A. Usmanova. „Regular linear surfaces in architecture and construction“. Journal of Physics: Conference Series 1441 (Januar 2020): 012065. http://dx.doi.org/10.1088/1742-6596/1441/1/012065.
Der volle Inhalt der QuellePolimeni, Beniamino. „PRODUCING DESIGN OBJECTS FROM REGULAR POLYHEDRA: A PRACTICAL APPROACH“. Boletim da Aproged, Nr. 34 (Dezember 2018): 49–55. http://dx.doi.org/10.24840/2184-4933_2018-0034_0007.
Der volle Inhalt der QuelleDEPRETTERE, ED F., PETER HELD und PAUL WIELAGE. „MODEL AND METHODS FOR REGULAR ARRAY DESIGN“. International Journal of High Speed Electronics and Systems 04, Nr. 02 (Juni 1993): 133–201. http://dx.doi.org/10.1142/s012915649300008x.
Der volle Inhalt der QuelleLalvani, Haresh. „Higher Dimensional Periodic Table Of Regular And Semi-Regular Polytopes“. International Journal of Space Structures 11, Nr. 1-2 (April 1996): 155–71. http://dx.doi.org/10.1177/026635119601-222.
Der volle Inhalt der QuelleBadran, Tamer, Hany Ahmad und Mohamad Abdel-Gawad. „A reconfigurable multi-byte regular-expression matching architecture“. International Conference on Electrical Engineering 6, Nr. 6 (01.05.2008): 1–10. http://dx.doi.org/10.21608/iceeng.2008.34330.
Der volle Inhalt der QuelleHawkes. „A Regular Fault-Tolerant Architecture for Interconnection Networks“. IEEE Transactions on Computers C-34, Nr. 7 (Juli 1985): 677–80. http://dx.doi.org/10.1109/tc.1985.1676608.
Der volle Inhalt der QuelleMangard, S., M. Aigner und S. Dominikus. „A highly regular and scalable aes hardware architecture“. IEEE Transactions on Computers 52, Nr. 4 (April 2003): 483–91. http://dx.doi.org/10.1109/tc.2003.1190589.
Der volle Inhalt der QuelleLee, Tsern-Huei. „Hardware Architecture for High-Performance Regular Expression Matching“. IEEE Transactions on Computers 58, Nr. 7 (Juli 2009): 984–93. http://dx.doi.org/10.1109/tc.2008.145.
Der volle Inhalt der QuelleBeck Lassen, Frank. „Regular, Dependable, Mechanical“. Contributions to the History of Concepts 5, Nr. 1 (01.05.2009): 94–116. http://dx.doi.org/10.1163/187465609x430872.
Der volle Inhalt der QuelleYun, SangKyun. „Regular Expression Matching Processor Architecture Supporting Character Class Matching“. Journal of KIISE 42, Nr. 10 (15.10.2015): 1280–85. http://dx.doi.org/10.5626/jok.2015.42.10.1280.
Der volle Inhalt der QuelleLi, Qiyue, Jie Li, Jianping Wang, Baohua Zhao und Yugui Qu. „A pipelined processor architecture for regular expression string matching“. Microprocessors and Microsystems 36, Nr. 6 (August 2012): 520–26. http://dx.doi.org/10.1016/j.micpro.2012.04.004.
Der volle Inhalt der QuelleShi, Jiang Yi, Jie Pang, Zhi Xiong Di, Yao Hui Liu und Yun Song Li. „High Throughput VLSI Architecture of MQ-Coder for JPEG2000“. Advanced Materials Research 403-408 (November 2011): 2321–24. http://dx.doi.org/10.4028/www.scientific.net/amr.403-408.2321.
Der volle Inhalt der QuelleHAEGEMAN, LILIANE, ANDRÉ MEINUNGER und ALEKSANDRA VERCAUTEREN. „The architecture of it-clefts“. Journal of Linguistics 50, Nr. 2 (03.04.2013): 269–96. http://dx.doi.org/10.1017/s0022226713000042.
Der volle Inhalt der QuelleSong, Wei, Huijing Han, Jianhua Wu und Meiran Xie. „Ladder-like polyacetylene with excellent optoelectronic properties and regular architecture“. Chem. Commun. 50, Nr. 85 (29.08.2014): 12899–902. http://dx.doi.org/10.1039/c4cc05524a.
Der volle Inhalt der QuelleAstola, J., und D. Akopian. „Architecture-oriented regular algorithms for discrete sine and cosine transforms“. IEEE Transactions on Signal Processing 47, Nr. 4 (April 1999): 1109–24. http://dx.doi.org/10.1109/78.752608.
Der volle Inhalt der QuelleBrodie, Benjamin C., David E. Taylor und Ron K. Cytron. „A Scalable Architecture For High-Throughput Regular-Expression Pattern Matching“. ACM SIGARCH Computer Architecture News 34, Nr. 2 (Mai 2006): 191–202. http://dx.doi.org/10.1145/1150019.1136500.
Der volle Inhalt der QuelleManic, Bozidar, Dragana Vasiljevic-Tomic und Ana Nikovic. „Contemporary Serbian Orthodox church architecture: Architectural competitions since 1990“. Spatium, Nr. 35 (2016): 10–21. http://dx.doi.org/10.2298/spat1635010m.
Der volle Inhalt der QuelleKreft, Lev. „Architecture through sport“. SAJ - Serbian Architectural Journal 4, Nr. 2 (2012): 176–87. http://dx.doi.org/10.5937/saj1202176k.
Der volle Inhalt der QuelleNeumann, B., T. von Sydow, H. Blume und T. G. Noll. „Design and quantitative analysis of parametrisable eFPGA-architectures for arithmetic“. Advances in Radio Science 4 (06.09.2006): 251–57. http://dx.doi.org/10.5194/ars-4-251-2006.
Der volle Inhalt der QuelleGanjikunta, Ganesh Kumar, Sibghatullah I. Khan und M. Mahaboob Basha. „A High-Performance Signed-Unsigned Multiplier Using Vedic Mathematics“. Journal of Low Power Electronics 15, Nr. 3 (01.09.2019): 302–8. http://dx.doi.org/10.1166/jolpe.2019.1616.
Der volle Inhalt der QuelleAbd Elaal, Mohamed, und Fadhel Ghannouchi. „A2×1LINC Transceiver for Enhanced Power Transmission in Wireless Systems“. Research Letters in Communications 2007 (2007): 1–4. http://dx.doi.org/10.1155/2007/45301.
Der volle Inhalt der QuelleBensaci, Chaima, Youcef Zennir, Denis Pomorski, Fares Innal und Yiliu Liu. „Distributed vs. Hybrid Control Architecture Using STPA and AHP - Application to an Autonomous Mobile Multi-robot System“. International Journal of Safety and Security Engineering 11, Nr. 1 (28.02.2021): 1–12. http://dx.doi.org/10.18280/ijsse.110101.
Der volle Inhalt der QuelleLinhai, Cui. „An Innovative Approach for Regular Expression Matching Based on NoC Architecture“. International Journal of Smart Home 8, Nr. 1 (31.01.2014): 45–52. http://dx.doi.org/10.14257/ijsh.2014.8.1.06.
Der volle Inhalt der QuelleYang, Yi-Hua, und Viktor Prasanna. „High-Performance and Compact Architecture for Regular Expression Matching on FPGA“. IEEE Transactions on Computers 61, Nr. 7 (Juli 2012): 1013–25. http://dx.doi.org/10.1109/tc.2011.129.
Der volle Inhalt der QuelleMatschegewski, Claudia, Susanne Staehlke, Ronny Loeffler, Regina Lange, Feng Chai, Dieter P. Kern, Ulrich Beck und Barbara J. Nebe. „Cell architecture–cell function dependencies on titanium arrays with regular geometry“. Biomaterials 31, Nr. 22 (August 2010): 5729–40. http://dx.doi.org/10.1016/j.biomaterials.2010.03.073.
Der volle Inhalt der QuelleShi, Yuanyuan. „The Three Levels of Education in Site Design Course of Architecture“. Journal of World Architecture 5, Nr. 3 (08.06.2021): 18–23. http://dx.doi.org/10.26689/jwa.v5i3.2178.
Der volle Inhalt der QuelleCui, Linhai, Yusen Qin, Fanyang Kong und Kaihong Yu. „Design of a Regular Expression Matching System Based on Network on Chip“. Open Electrical & Electronic Engineering Journal 7, Nr. 1 (14.06.2013): 46–50. http://dx.doi.org/10.2174/1874129001307010046.
Der volle Inhalt der QuelleKYRIAKIS-BITZAROS, E. D., D. J. SOUDRIS und C. E. GOUTIS. „TRANSFORMATION OF NESTED LOOPS INTO UNIFORM RECURRENCES AND THEIR MAPPING TO REGULAR PROCESSOR ARRAYS“. Journal of Circuits, Systems and Computers 06, Nr. 03 (Juni 1996): 243–65. http://dx.doi.org/10.1142/s0218126696000194.
Der volle Inhalt der QuelleAL-TOWAIQ, MOHAMMAD H., und KHALED DAY. „PARALLEL GAUSS-SEIDEL ON A TORUS NETWORK-ON-CHIP ARCHITECTURE“. Journal of Interconnection Networks 13, Nr. 01n02 (März 2012): 1250001. http://dx.doi.org/10.1142/s0219265912500016.
Der volle Inhalt der QuelleGal-Ezer, Judith, und Mark Trakhtenbrot. „Algebraic characterization of regular languages“. ACM SIGCSE Bulletin 38, Nr. 3 (26.09.2006): 325. http://dx.doi.org/10.1145/1140123.1140232.
Der volle Inhalt der QuelleNarayan, Apurva, Greta Cutulenco, Yogi Joshi und Sebastian Fischmeister. „Mining Timed Regular Specifications from System Traces“. ACM Transactions on Embedded Computing Systems 17, Nr. 2 (26.04.2018): 1–21. http://dx.doi.org/10.1145/3147660.
Der volle Inhalt der Quellede Paulo, Vitor, und Cristinel Ababei. „3D Network-on-Chip Architectures Using Homogeneous Meshes and Heterogeneous Floorplans“. International Journal of Reconfigurable Computing 2010 (2010): 1–12. http://dx.doi.org/10.1155/2010/603059.
Der volle Inhalt der QuelleGuey-Yun Chang, G. J. Chang und Gen-Huey Chen. „Diagnosabilities of regular networks“. IEEE Transactions on Parallel and Distributed Systems 16, Nr. 4 (April 2005): 314–23. http://dx.doi.org/10.1109/tpds.2005.44.
Der volle Inhalt der QuelleTang, Qiu, Lei Jiang, Xin-xing Liu und Qiong Dai. „A Real-time Updatable FPGA-based Architecture for Fast Regular Expression Matching“. Procedia Computer Science 31 (2014): 852–59. http://dx.doi.org/10.1016/j.procs.2014.05.336.
Der volle Inhalt der QuelleYun, Sang-Kyun, und Kyu-Hee Lee. „A Hardware Architecture of Regular Expression Pattern Matching for Deep Packet Inspection“. Journal of the Korea Society of Computer and Information 16, Nr. 5 (31.05.2011): 13–22. http://dx.doi.org/10.9708/jksci.2011.16.5.013.
Der volle Inhalt der QuelleDay, Khaled, und Mohammad H. Al-Towaiq. „An Efficient Parallel Gauss-Seidel Algorithm on a 3D Torus Network-on-Chip“. Sultan Qaboos University Journal for Science [SQUJS] 20, Nr. 1 (01.06.2015): 29. http://dx.doi.org/10.24200/squjs.vol20iss1pp29-38.
Der volle Inhalt der QuelleZhang, Yanjun, und S. Q. Zheng. „An Efficient Parallel VLSI Sorting Architecture“. VLSI Design 11, Nr. 2 (01.01.2000): 137–47. http://dx.doi.org/10.1155/2000/14617.
Der volle Inhalt der QuelleTyng, Anne Griswold. „Inner Vision Toward An Architecture Of Organic Humanism“. International Journal of Space Structures 11, Nr. 1-2 (April 1996): 69–84. http://dx.doi.org/10.1177/026635119601-213.
Der volle Inhalt der QuelleGuo, Shaori, und Wayne Luk. „An integrated system for developing regular array designs“. Journal of Systems Architecture 47, Nr. 3-4 (April 2001): 315–37. http://dx.doi.org/10.1016/s1383-7621(00)00052-7.
Der volle Inhalt der QuelleCachera, David, und Katell Morin-Allory. „Verification of safety properties for parameterized regular systems“. ACM Transactions on Embedded Computing Systems 4, Nr. 2 (Mai 2005): 228–66. http://dx.doi.org/10.1145/1067915.1067917.
Der volle Inhalt der QuelleMajumdar, Rupak, Elaine Render und Paulo Tabuada. „A theory of robust omega-regular software synthesis“. ACM Transactions on Embedded Computing Systems 13, Nr. 3 (Dezember 2013): 1–27. http://dx.doi.org/10.1145/2539036.2539044.
Der volle Inhalt der QuelleBaverel, Olivier, und Hoshyar Nooshin. „Nexorades Based on Regular Polyhedra“. Nexus Network Journal 9, Nr. 2 (Oktober 2007): 281–98. http://dx.doi.org/10.1007/s00004-007-0043-0.
Der volle Inhalt der QuelleKeller, Jörg. „Regular layouts of butterfly networks“. Integration 17, Nr. 3 (November 1994): 253–63. http://dx.doi.org/10.1016/0167-9260(94)90003-5.
Der volle Inhalt der QuelleLv, Yisheng, Liquan Wang, Fan Liu, Weisheng Feng, Jie Wei und Shaoliang Lin. „Self-assembly of amphiphilic alternating copolymers with stimuli-responsive rigid pendant groups“. Polymer Chemistry 11, Nr. 29 (2020): 4798–806. http://dx.doi.org/10.1039/d0py00765j.
Der volle Inhalt der QuelleMelenka, Garrett W., und Jason P. Carey. „Development of a generalized analytical model for tubular braided-architecture composites“. Journal of Composite Materials 51, Nr. 28 (21.02.2017): 3861–75. http://dx.doi.org/10.1177/0021998317695421.
Der volle Inhalt der QuelleLamb, Matthew D. „Traceur as Bricoleur. Poaching public space through bricolent use of architecture and the body“. Journal of Public Space 2, Nr. 1 (01.05.2017): 33. http://dx.doi.org/10.5204/jps.v2i1.48.
Der volle Inhalt der QuelleVerdier, F., und D. Declercq. „A low-cost parallel scalable FPGA architecture for regular and irregular LDPC decoding“. IEEE Transactions on Communications 54, Nr. 7 (Juli 2006): 1215–23. http://dx.doi.org/10.1109/tcomm.2006.877980.
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